[发明专利]非易失性存储器器件的感测电路和操作方法在审

专利信息
申请号: 201910653554.4 申请日: 2019-07-18
公开(公告)号: CN111009276A 公开(公告)日: 2020-04-14
发明(设计)人: 辛贤真 申请(专利权)人: 三星电子株式会社
主分类号: G11C16/24 分类号: G11C16/24;G11C16/08;G11C16/04
代理公司: 中科专利商标代理有限责任公司 11021 代理人: 杨姗
地址: 韩国*** 国省代码: 暂无信息
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摘要:
搜索关键词: 非易失性存储器 器件 电路 操作方法
【权利要求书】:

1.一种非易失性存储器器件的感测电路,所述感测电路包括:

预充电电流产生器,连接到感测节点,所述预充电电流产生器被配置为响应于预充电信号产生预充电电流,所述预充电电流被提供给所述非易失性存储器器件的位线;

调整晶体管,连接在所述感测节点和与所述位线耦接的第一节点之间,所述调整晶体管被配置为响应于第一控制电压调整被提供给所述位线的所述预充电电流的量;以及

自适应控制电压产生器,被配置为响应于所述预充电信号和第二控制电压产生与所述非易失性存储器器件的操作温度成比例的控制电流,并且被配置为基于所述控制电流与所述操作温度成比例地对所述第一控制电压的电平进行升压,其中所述第二控制电压与所述操作温度成反比。

2.根据权利要求1所述的感测电路,还包括:

电流调整电路,连接到所述第一节点并且在第二节点处与所述调整晶体管和所述自适应控制电压产生器连接,所述电流调整电路被配置为响应于所述第一节点的电压调整要提供给所述第二节点的所述控制电流。

3.根据权利要求2所述的感测电路,其中,所述自适应控制电压产生器包括串联连接在电源电压和所述第二节点之间的第一p沟道金属氧化物半导体PMOS晶体管和第二PMOS晶体管,

其中,所述第一PMOS晶体管包括耦接到所述电源电压的源极、接收所述预充电信号的栅极和耦接到所述第二PMOS晶体管的漏极,

其中,所述第二PMOS晶体管包括耦接到所述第一PMOS晶体管的源极、接收所述第二控制电压的栅极和耦接到所述第二节点的漏极,以及

其中,所述第二PMOS晶体管被配置为响应于所述第二控制电压向所述第二节点提供所述控制电流。

4.根据权利要求3所述的感测电路,其中,所述自适应控制电压产生器被配置为:

通过响应于所述操作温度的增加而增加所述控制电流来增加所述第一控制电压的电平,以及

通过响应于所述操作温度的降低而减小所述控制电流来减小所述第一控制电压的电平。

5.根据权利要求2所述的感测电路,其中,所述调整晶体管包括n沟道金属氧化物半导体NMOS晶体管,所述NMOS晶体管具有耦接到所述感测节点的漏极、耦接到所述第二节点的栅极和耦接到所述第一节点的源极,以及

其中,所述调整晶体管被配置为响应于所述第一控制电压,根据所述操作温度的增加来增加被提供给所述位线的所述预充电电流的量。

6.根据权利要求2所述的感测电路,其中,所述电流调整电路包括:

p沟道金属氧化物半导体PMOS晶体管,连接在电源电压和所述第二节点之间;以及

n沟道金属氧化物半导体NMOS晶体管,连接在所述第二节点和地电压之间,

其中,所述PMOS晶体管包括耦接到所述电源电压的源极、耦接到所述地电压的栅极和耦接到所述第二节点的漏极,

其中,所述NMOS晶体管包括耦接到所述第二节点的漏极、耦接到所述第一节点的栅极和耦接到所述地电压的源极,以及

其中,所述NMOS晶体管响应于所述第一节点的电压而导通,以减小所述第一控制电压的电平。

7.根据权利要求2所述的感测电路,还包括:

负载电流产生器,与所述预充电电流产生器并联连接到所述感测节点,其中,所述负载电流产生器被配置为响应于所述第二控制电压产生要提供给所述位线的负载电流,

其中,所述负载电流产生器包括p沟道金属氧化物半导体PMOS晶体管,并且被配置为响应于所述第二控制电压向所述感测节点提供与所述操作温度的增加成比例地增加的所述负载电流。

8.根据权利要求2所述的感测电路,还包括:

控制电压产生器,被配置为产生与所述操作温度成比例的输出电流、以及与绝对温度成比例PTAT电流成反比的所述第二控制电压;以及

预充电信号控制器,被配置为产生所述预充电信号,并且基于所述第二控制电压控制所述预充电信号的脉冲宽度。

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