[发明专利]基于FPGA的多源单输出复位方法、装置及相关设备有效
| 申请号: | 201910574679.8 | 申请日: | 2019-06-28 |
| 公开(公告)号: | CN110399026B | 公开(公告)日: | 2021-12-03 |
| 发明(设计)人: | 王峰 | 申请(专利权)人: | 苏州浪潮智能科技有限公司 |
| 主分类号: | G06F1/24 | 分类号: | G06F1/24 |
| 代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 潘颖 |
| 地址: | 215100 江苏省苏州市吴*** | 国省代码: | 江苏;32 |
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| 摘要: | |||
| 搜索关键词: | 基于 fpga 多源单 输出 复位 方法 装置 相关 设备 | ||
1.一种基于FPGA的多源单输出复位方法,其特征在于,包括:
获取待复位模块的配置信息包括:获取所述待复位模块的标识;依据所述标识,查找与所述标识匹配的配置文件;
依据所述配置信息确定待复位模块的各个目标复位源、所述各个目标复位源的目标复位信号的复位顺序、以及在所述复位顺序下所述各个目标复位信号之间的延时周期,包括:获取所述配置文件中包含的待过滤复位源、延时周期和复位顺序;在各个复位源中将所述待过滤复位源进行删除,得到各个目标复位源;将所述各个目标复位源的复位信号进行或操作生成各个目标复位信号;依据所述复位顺序对所述各个目标复位信号进行排序且各个目标复位信号之间间隔对应的延时周期;
依据所述复位顺序,当时间满足对应的延时周期时,依据对应的目标复位信号对所述待复位模块进行复位。
2.根据权利要求1所述的方法,其特征在于,还包括:
若系统中还存在与所述待复位模块的复位源和/或复位顺序和/或延时周期不同的其余待复位模块时,为所述其余待复位模块单独设定复位源、复位源的目标复位信号的复位顺序、以及在所述复位顺序下所述各个目标复位信号之间的延时周期。
3.根据权利要求1所述的方法,其特征在于,还包括:
获取所述配置信息中的复位类型;
依据所述复位类型,在所述复位顺序下当时间满足对应的延时周期时,依据对应的目标复位信号对所述待复位模块进行复位。
4.一种基于FPGA的多源单输出复位装置,其特征在于,包括:
获取模块,用于获取待复位模块的配置信息;
所述获取模块包括:
第一获取单元,用于获取所述待复位模块的标识;
查找单元,用于依据所述标识,查找与所述标识匹配的配置文件;
确定模块,用于依据所述配置信息确定待复位模块的各个目标复位源、所述各个目标复位源的目标复位信号的复位顺序、以及在所述复位顺序下所述各个目标复位信号之间的延时周期;
所述确定模块包括:
第二获取单元,用于获取所述配置文件中包含的待过滤复位源、延时周期和复位顺序;
删除单元,用于在各个复位源中将所述待过滤复位源进行删除,得到各个目标复位源;
异或单元,用于将所述各个目标复位源的复位信号进行或操作生成各个目标复位信号;
排序单元,用于依据所述复位顺序对所述各个目标复位信号进行排序且各个目标复位信号之间间隔对应的延时周期;
复位模块,用于依据所述复位顺序,当时间满足对应的延时周期时,依据对应的目标复位信号对所述待复位模块进行复位。
5.一种存储介质,其特征在于,所述存储介质包括存储的程序,其中,所述程序执行权利要求1至3中任意一项所述的基于FPGA的多源单输出复位方法。
6.一种处理器,其特征在于,所述处理器用于运行程序,其中,所述程序运行时执行权利要求1至3中任意一项所述的基于FPGA的多源单输出复位方法。
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