[发明专利]芯片封装结构的制作方法有效
申请号: | 201910539429.0 | 申请日: | 2019-06-20 |
公开(公告)号: | CN112117202B | 公开(公告)日: | 2023-01-24 |
发明(设计)人: | 周辉星 | 申请(专利权)人: | 矽磐微电子(重庆)有限公司 |
主分类号: | H01L21/56 | 分类号: | H01L21/56;H01L21/60 |
代理公司: | 北京博思佳知识产权代理有限公司 11415 | 代理人: | 张相钦 |
地址: | 401331 重*** | 国省代码: | 重庆;50 |
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摘要: | |||
搜索关键词: | 芯片 封装 结构 制作方法 | ||
本发明提供了一种芯片封装结构的制作方法,通过将多晶粒封装结构划分为若干区域,每一区域包含若干晶粒;在晶粒封装结构上形成包埋外引脚的第二塑封层时,使用具有分隔板的多腔模具对第二塑封层进行固化。多腔模具可以将第二塑封层固化收缩的范围由一整块减少到若干小块,从而液态塑封料固化时收缩应力由于收缩范围减小而成倍减小,多晶粒封装结构的翘曲程度得以减小,进而可以改善外引脚的电连接可靠性问题。
技术领域
本发明涉及芯片封装技术领域,尤其涉及一种芯片封装结构的制作方法。
背景技术
近年来,随着电路集成技术的不断发展,电子产品越来越向小型化、智能化、高性能以及高可靠性方向发展。封装技术不但影响产品的性能,而且还制约产品的小型化。
然而,现有芯片封装生产效率较低、封装结构性能不可靠。
有鉴于此,本发明提供一种新的芯片封装结构的制作方法,以解决上述技术问题。
发明内容
本发明的发明目的是提供一种芯片封装结构的制作方法,提升生产效率、提高封装结构性能可靠性。
为实现上述目的,本发明提供一种芯片封装结构的制作方法,包括:
提供多晶粒封装结构,所述多晶粒封装结构包括第一塑封层以及包埋在所述第一塑封层内的多个晶粒,每一所述晶粒包括正面与背面,所述正面具有电互连结构;所述正面暴露于所述第一塑封层外;
在所述多晶粒封装结构中每一晶粒的正面形成外引脚;
将所述多晶粒封装结构划分为若干区域,每一区域包含若干晶粒;在所述多晶粒封装结构上形成包埋所述外引脚的第二塑封层,所述第二塑封层使用具有分隔板的多腔模具固化,所述分隔板位于相邻区域之间,用于隔断开第二塑封层;
研磨所述第二塑封层直至暴露出所述外引脚,形成多芯片封装结构;
切割所述多芯片封装结构形成多个芯片封装结构。
可选地,所述第二塑封层通过热压贴装的塑封膜形成,贴装的塑封膜在相邻区域之间具有间隔,所述间隔用于容纳所述分隔板。
可选地,所述第二塑封层通过注塑工艺形成。
可选地,每一区域的面积相等。
可选地,每一区域内的晶粒数目相等。
可选地,在所述多晶粒封装结构中每一晶粒的正面形成再布线层,所述外引脚形成在所述再布线层上;或在所述多晶粒封装结构中每一晶粒的正面依次形成再布线层以及扇出线路,所述外引脚形成在所述扇出线路上。
可选地,形成再布线层包括:
在所暴露的每一晶粒的正面以及第一塑封层上形成光刻胶层;
曝光显影所述光刻胶层,去除第一预定区域的光刻胶层,所述第一预定区域对应所述晶粒正面的焊盘,所述焊盘与所述电互连结构电连接;
在所述第一预定区域填充金属层以形成所述再布线层;
灰化去除剩余的光刻胶层。
可选地,在所述再布线层上形成扇出线路包括:
在所述第一塑封层以及再布线层上形成第三塑封层;
去除所述第三塑封层的部分区域形成通孔,所述通孔暴露所述再布线层;
在所述通孔内以及通孔外的第三塑封层上形成光刻胶层;
曝光显影所述光刻胶层保留第二预定区域的光刻胶层;
在所述第二预定区域的互补区域填充金属层以形成所述扇出线路;
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造