[发明专利]一种基于指令的DRAM控制器带宽效率检测方法有效
| 申请号： | 201910070960.8 | 申请日： | 2019-01-25 |
| 公开（公告）号： | CN109857616B | 公开（公告）日： | 2021-05-18 |
| 发明（设计）人： | 石易明;李风志;戴绍新;姚香君;李文军 | 申请（专利权）人： | 山东华芯半导体有限公司 |
| 主分类号： | G06F11/30 | 分类号： | G06F11/30;G06F11/34 |
| 代理公司： | 济南泉城专利商标事务所 37218 | 代理人： | 赵玉凤 |
| 地址： | 250101 山东省济南市高新*** | 国省代码： | 山东;37 |
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| 摘要： | |||
| 搜索关键词： | 一种 基于 指令 dram 控制器 带宽 效率 检测 方法 | ||
【权利要求书】：
1.一种基于指令的DRAM控制器带宽效率检测方法，其特征在于：按照DRAM接口时序抓取主控制器与DRAM颗粒间的读写指令和时钟信号线，监测读写指令，从读写指令中抓取BC4读指令数、BC4写指令数、BL8读指令数、BL8写指令数，从时钟信号线中抓取检测时段内的DRAM时钟周期数，然后根据公式
计算控制器的带宽效率。
2.根据权利要求1所述的基于指令的DRAM控制器带宽效率检测方法，其特征在于：监测读写指令逻辑简化成对CS、ACT、RAS、CAS四个信号的监测，然后通过A12信号区别BC4指令或者BL8指令，A12为0则为BC4指令，反之则为BL8指令。
3.根据权利要求2所述的基于指令的DRAM控制器带宽效率检测方法，其特征在于：当CS=0、ACT=1、RAS=1、CAS=0，并且A12=0时，监测到的指令为一次针对BC4的读或写指令，此时在现有值的基础上加2；当CS=0、ACT=1、RAS=1、CAS=0，并且A12=1时，监测到的指令为一次针对BL8的读或写指令，此时在现有值的基础上加4。
4.根据权利要求1所述的基于指令的DRAM控制器带宽效率检测方法，其特征在于：利用systemverilog或verilog语言做成的monitor抓取主控制器与DRAM颗粒间的读写指令和时钟信号线。
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