[发明专利]电路测试系统及电路测试方法有效

专利信息
申请号: 201910042985.7 申请日: 2019-01-17
公开(公告)号: CN111443275B 公开(公告)日: 2022-06-17
发明(设计)人: 陈莹晏;许烱发;杨嘉瑞;陈柏霖 申请(专利权)人: 瑞昱半导体股份有限公司
主分类号: G01R31/28 分类号: G01R31/28
代理公司: 北京康信知识产权代理有限责任公司 11240 代理人: 梁丽超;田喜庆
地址: 中国台*** 国省代码: 台湾;71
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摘要:
搜索关键词: 电路 测试 系统 方法
【权利要求书】:

1.一种电路测试系统,包含:

一控制电路,电性连接于一测试机台,且用以接收一扫描控制信号;以及

一接口电路,电性连接于该控制电路、该测试机台、一扫描链电路及一待测电路;其中在该扫描控制信号处于一第一电平时,该控制电路用以控制该接口电路将该测试机台传来的一扫描测试信号传送给该扫描链电路;

在该扫描控制信号处于一第二电平时,该控制电路用以控制该接口电路将该待测电路产生的一响应信号传递至该测试机台;

其中,该接口电路包含:

一第一输入输出单元,在该扫描控制信号处于该第一电平时,该控制电路控制该接口电路以通过该第一输入输出单元接收该扫描测试信号;以及

一第二输入输出单元,在该扫描控制信号处于该第一电平时,该控制电路控制该接口电路以通过该第二输入输出单元将该扫描链电路产生的一扫描响应信号传递至该测试机台,

其中该待测电路电性连接于该第一输入输出单元的一第一输入端及一第一输出端,和/或该待测电路电性连接于该第二输入输出单元的一第二输入端及一第二输出端。

2.如权利要求1所述的电路测试系统,其中,在该扫描控制信号处于该第二电平时,该第二输入输出单元将该待测电路产生的该响应信号传递至该测试机台。

3.如权利要求1所述的电路测试系统,其中在该扫描控制信号处于该第二电平时,该第一输入输出单元将该待测电路产生的该响应信号传递至该测试机台。

4.如权利要求1所述的电路测试系统,其中该第一输入输出单元包含一第一控制端、一第一测试端及一第一输出端;该第一控制端电性连接于该控制电路,该第一测试端电性连接于该测试机台,该第一输出端电性连接于该扫描链电路;

其中该第二输入输出单元包含一第二控制端、一第二测试端及一第二输入端;该第二控制端电性连接于该控制电路,该第二测试端电性连接于该测试机台,该第二输入端电性连接于该扫描链电路。

5.如权利要求4所述的电路测试系统,其中该控制电路包含一开关电路及一逻辑电路,该开关电路电性连接于该逻辑电路,且用以接收该扫描控制信号;在该扫描控制信号处于该第二电平时,该开关电路将该逻辑电路导通至该接口电路。

6.如权利要求5所述的电路测试系统,其中该开关电路还用以接收一扫描辅助信号,在该扫描控制信号处于该第二电平、且该扫描辅助信号处于一禁能电平时,该待测电路通过该接口电路,传送该响应信号至该测试机台;在该扫描控制信号处于该第二电平、且该扫描辅助信号处于一致能电平时,该接口电路用以接收该测试机台传来的一测试信号。

7.如权利要求6所述的电路测试系统,其中该待测电路电性连接于该第一输入输出单元的该第一输入端及该第一输出端;在该扫描控制信号从该第一电平转变为该第二电平时,该测试机台在经过一第一转回时间后,发送一第一测试信号至该第一输入输出单元;在该测试机台通过该第一输入输出单元,接收到该待测电路传来的该响应信号时,该测试机台将提前一第二转回时间,致能该扫描辅助信号。

8.如权利要求6所述的电路测试系统,其中该待测电路电性连接于该第二输入输出单元的该第二输入端及该第二输出端;在该扫描控制信号从该第一电平转变为该第二电平时,该测试机台在经过一第一转回时间后,发送一第二测试信号至该第二输入输出单元;在该测试机台通过该第二输入输出单元,接收到该待测电路传来的该响应信号时,该测试机台将提前一第二转回时间,致能该扫描辅助信号。

9.一种电路测试方法,包含:

通过一控制电路,接收一测试机台传来的一扫描控制信号;

在该扫描控制信号处于一第一电平时,通过该控制电路,控制一接口电路将该测试机台传来的一扫描测试信号传送至一扫描链电路;以及

在该扫描控制信号处于一第二电平时,通过该控制电路,控制该接口电路将待测电路产生的一响应信号传递至该测试机台;

其中,该接口电路包含:

一第一输入输出单元,在该扫描控制信号处于该第一电平时,该控制电路控制该接口电路以通过该第一输入输出单元接收该扫描测试信号;以及

一第二输入输出单元,在该扫描控制信号处于该第一电平时,该控制电路控制该接口电路以通过该第二输入输出单元将该扫描链电路产生的一扫描响应信号传递至该测试机台,

其中该待测电路电性连接于该第一输入输出单元的一第一输入端及一第一输出端,和/或该待测电路电性连接于该第二输入输出单元的一第二输入端及一第二输出端。

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