[实用新型]一种互斥逻辑控制电路有效

专利信息
申请号: 201821782794.1 申请日: 2018-10-31
公开(公告)号: CN208953920U 公开(公告)日: 2019-06-07
发明(设计)人: 郭建国;房红利;王西征;宋阳;刘懿如;刘朋武;王永猛 申请(专利权)人: 郑州天迈科技股份有限公司
主分类号: G05B19/042 分类号: G05B19/042
代理公司: 郑州明华专利代理事务所(普通合伙) 41162 代理人: 高丽华
地址: 450001 河南省郑州市高新区莲花街3*** 国省代码: 河南;41
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摘要:
搜索关键词: 互斥 输出端 译码器 驱动器 逻辑控制电路 输入端电连接 本实用新型 驱动器总成 中央处理器 控制线路 软件逻辑 输出终端 电连接 继电器 独立驱动器 多个驱动器 硬件可靠性 电路控制 控制电路 控制逻辑 硬件逻辑 支出
【权利要求书】:

1.一种互斥逻辑控制电路, 包括中央处理器、驱动器总成以及输出终端,其特征在于:在中央处理器与驱动器总成之间增设有译码器,所述中央处理器的输出端与译码器的输入端电连接,所述驱动器总成包括多个相互独立的驱动器,所述译码器的多个输出端分别与多个独立驱动器的输入端电连接,所述译码器自身在同一时间仅输出一个逻辑高电平,利用仅输出的一个逻辑高电平控制驱动器总成,各独立驱动器的多个输出端对应连接各自的继电器线圈端,各自的继电器常开端一接高压电源正极,各自的继电器常开端二作为输出终端。

2.根据权利要求1所述的一种互斥逻辑控制电路,其特征在于:所述各独立驱动器的各输入端上分别连接有反向器。

3.根据权利要求1所述的一种互斥逻辑控制电路,其特征在于:所述译码器为74HC154译码器,译码器输出控制引脚为G0、G1,地址引脚为A0~A4, 输出引脚为Y1~Y16;G0、G1同时为L状态时译码器有输出,G0、G1的其余任何一种状态,译码器均无输出;中央处理器控制A0~A4的地址引脚实现Y1~Y16的可选择性输出,且一组A0~A4的组合,只能使Y1~Y16之中的一路输出引脚为L状态,即输出低电平信号。

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