[实用新型]半导体结构及存储器结构有效
| 申请号: | 201821581728.8 | 申请日: | 2018-09-27 |
| 公开(公告)号: | CN209045554U | 公开(公告)日: | 2019-06-28 |
| 发明(设计)人: | 巩金峰 | 申请(专利权)人: | 长鑫存储技术有限公司 |
| 主分类号: | H01L27/1158 | 分类号: | H01L27/1158 |
| 代理公司: | 上海光华专利事务所(普通合伙) 31219 | 代理人: | 余明伟 |
| 地址: | 230601 安徽省合肥市合肥*** | 国省代码: | 安徽;34 |
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| 摘要: | |||
| 搜索关键词: | 填充层 底部抗反射涂层 半导体基底 侧墙结构 垫层 去除 半导体结构 本实用新型 存储器结构 位线接触 硬掩膜层 浅沟槽隔离结构 底部抗反射层 埋入式栅极 位线接触孔 光刻工艺 光刻曝光 刻蚀条件 偏移 字线 对准 | ||
1.一种半导体结构,其特征在于,包括:
半导体基底;
垫层结构,位于所述半导体基底的表面;
浅沟槽隔离结构,位于所述半导体基底及所述垫层结构内,以于所述半导体基底内隔离出若干个间隔排布的有源区;
硬掩膜层,位于所述垫层结构的表面;
底部抗反射涂层,位于所述硬掩膜层的表面;
填充层,位于所述底部抗反射涂层内,所述填充层定义出需要形成的位线接触的位置及形状;及
侧墙结构,位于所述底部抗反射涂层内,且位于所述填充层的外侧,所述侧墙结构定义出需要形成的埋入式栅极字线的位置及形状;其中,
于相同的刻蚀条件下,所述填充层的去除速率小于所述底部抗反射层的去除速率及所述侧墙结构的去除速率。
2.根据权利要求1所述的半导体结构,其特征在于,所述有源区内还形成有深阱区域。
3.根据权利要求1所述的半导体结构,其特征在于,所述垫层结构包括:
垫氧化层,位于所述半导体基底的表面;
垫氮化层,位于所述垫氧化层的表面。
4.根据权利要求1所述的半导体结构,其特征在于,所述硬掩膜层包括:
第一硬掩膜层,位于所述垫层结构的表面;及
第二硬掩膜层,位于所述第一硬掩膜层的表面。
5.一种存储器结构,其特征在于,包括:
半导体基底,所述半导体基底内形成有浅沟槽隔离结构,所述浅沟槽隔离结构在所述半导体基底内隔离出若干个间隔排布的有源区;
若干个间隔排布的埋入式栅极字线,位于所述有源区内,且所述埋入式栅极字线的上表面低于所述半导体基底的上表面;
位线接触,位于所述半导体基底上;及
介质层,位于所述埋入式栅极字线的表面,且填满所述位线接触之间的间隙。
6.根据权利要求5所述的存储器结构,其特征在于,所述有源区内还形成有深阱区域。
7.根据权利要求5所述的存储器结构,其特征在于,所述存储器结构还包括垫层结构,所述垫层结构位于所述埋入式栅极字线及所述位线接触之间的所述半导体基底的表面。
8.根据权利要求7所述的存储器结构,其特征在于,所述垫层结构包括:
垫氧化层,位于所述半导体基底的表面;及
垫氮化层,位于所述垫氧化层的表面。
9.根据权利要求5所述的存储器结构,其特征在于,所述位线接触的底部陷入于所述半导体基底内。
10.根据权利要求5所述的存储器结构,其特征在于,所述埋入式栅极字线包括:
栅极导电层,位于所述有源区内,所述栅极导电层的上表面低于所述半导体基底的上表面;及
栅极氧化层,位于所述有源区内,且位于所述栅极导电层与所述半导体基底之间。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的





