[实用新型]数据压缩电路、存储器及集成电路测试装置有效
| 申请号： | 201821397381.1 | 申请日： | 2018-08-28 |
| 公开（公告）号： | CN208766272U | 公开（公告）日： | 2019-04-19 |
| 发明（设计）人： | 不公告发明人 | 申请（专利权）人： | 长鑫存储技术有限公司 |
| 主分类号： | G01R31/28 | 分类号： | G01R31/28 |
| 代理公司： | 北京律智知识产权代理有限公司 11438 | 代理人： | 袁礼君;阚梓瑄 |
| 地址： | 230000 安徽省合肥市*** | 国省代码： | 安徽;34 |
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| 摘要： | |||
| 搜索关键词： | 数据压缩电路 数据读取电路 数据写入电路 集成电路测试装置 输出接口 输入接口 存储器 测试集成电路 数据读取模块 数据写入模块 测试成本 测试效率 | ||
1.一种数据压缩电路，用于测试集成电路，其特征在于，所述数据压缩电路包括数据写入电路和数据读取电路；
其中，所述数据写入电路包括：
一个第一输入接口，所述第一输入接口用于接收测试数据；
多个第一输出接口，所述第一输出接口与所述集成电路相连；
数据写入模块，所述数据写入模块根据所述第一输入接口接收到的测试数据通过多个所述第一输出接口向所述集成电路写入数据；
所述数据读取电路包括：
多个第二输入接口，所述第二输入接口与所述集成电路相连；
一个第二输出接口，所述第二输出接口与所述测试数据的发送方相连；
数据读取模块，所述数据读取模块通过多个所述第二输入接口从所述集成电路读取数据，根据所述数据生成测试结果，并通过所述第二输出接口向所述测试数据的发送方返回所述测试结果。
2.根据权利要求1所述的数据压缩电路，其特征在于，所述第一输出接口和所述第二输入接口均与所述集成电路的数据通道相连。
3.根据权利要求2所述的数据压缩电路，其特征在于，所述数据通道两两组合形成数据通道对；
所述数据写入模块通过所述第一输出接口向每个数据通道对内的两个数据通道写入相同的测试数据；
所述数据读取模块通过所述第二输入接口从每个数据通道对内的两个数据通道读取数据，并比较从所述两个数据通道读取的数据是否相同。
4.根据权利要求3所述的数据压缩电路，其特征在于，所述数据读取模块包括：
多个同或门元件，所述同或门元件的输入端与所述第二输入接口相连；
一个或者多个与门元件，所述与门元件的输入端与所述同或门元件的输出端相连，所述与门元件的输出端与所述第二输出接口相连。
5.根据权利要求1所述的数据压缩电路，其特征在于，所述第一输出接口与所述第二输入接口数量相同。
6.根据权利要求1所述的数据压缩电路，其特征在于，所述数据写入模块包括一个或者多个解复用器。
7.根据权利要求1所述的数据压缩电路，其特征在于，所述数据读取模块包括一个或者多个复用器。
8.一种存储器，包括具有多个数据通道的集成电路，其特征在于，所述存储器还包括如权利要求1-7中任意一项所述的数据压缩电路，所述数据通道分别与所述数据压缩电路的第二输入接口和第一输出接口相连。
9.一种集成电路测试装置，包括多个测试通道，其特征在于，所述集成电路测试装置还包括如权利要求1-7中任意一项所述的数据压缩电路，所述测试通道分别与所述数据压缩电路的第一输入接口和第二输出接口相连。
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