[实用新型]信号速率判别电路有效
| 申请号: | 201821129665.2 | 申请日: | 2018-07-17 |
| 公开(公告)号: | CN208673325U | 公开(公告)日: | 2019-03-29 |
| 发明(设计)人: | 周杰;章可循;潘剑华;葛军华 | 申请(专利权)人: | 厦门优迅高速芯片有限公司 |
| 主分类号: | G06F13/40 | 分类号: | G06F13/40 |
| 代理公司: | 厦门市首创君合专利事务所有限公司 35204 | 代理人: | 杨依展;张迪 |
| 地址: | 361000 福建省*** | 国省代码: | 福建;35 |
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| 摘要: | |||
| 搜索关键词: | 计数单元 判别单元 高电平 上升沿 下降沿 输出低电平 计数电路 判别电路 判决电路 协议信号 本实用新型 高电平信号 并行设置 输出信号 延时判别 预设条件 输出 低电平 噪声 采集 | ||
1.一种信号速率判别电路,其特征在于包括:并行设置的幅值判决电路和上升沿/下降沿计数电路;所述幅值判决电路和上升沿/下降沿计数电路分别独立判断输入信号的幅值和上升沿/下降沿的个数;若两者同时/任一满足预设条件,则判断输入信号为协议信号;
所述上升沿/下降沿计数电路包括第一计数单元、第二计数单元和第三计数单元,其输入端分别与输入信号DIN连接;当输入信号的第一个上升沿/下降沿到来时,第一计数单元输出高电平信号;
所述第一计数单元输出的高电平信号经过第一延迟单元后形成延时判别信号,并输入判别单元;所述第二计数单元、第三计数单元输出的信号也输入所述判别单元;在延迟时间tset内,若输入信号有第M个上升沿/下降沿到来时,第二计数单元输出高电平信号;若输入信号有第N个上升沿/下降沿到来时,第三计数单元输出高电平信号,N>M;
所述判别单元在延时判别信号的高电平到来时,采集第二计数单元和第三计数单元的输出信号,若二者皆为低电平或者皆为高电平,则判别单元输出低电平信号,判断该输入信号为噪声;若第二计数单元输出高电平、第三计数单元输出低电平,则判别单元输出高电平信号,判断该输入信号为协议信号。
2.根据权利要求1所述的一种信号速率判别电路,其特征在于:所述第一延迟单元的延迟时间tset,根据用户需要自行设置。
3.根据权利要求1所述的一种信号速率判别电路,其特征在于:当所述判别单元输出低电平信号时,所述延时判别信号经过第二延迟单元再延时一定时间后,形成一复位触发信号;当复位触发信号的高电平到来时,复位反馈单元生成一低电平的复位反馈信号。
4.根据权利要求3所述的一种信号速率判别电路,其特征在于:所述复位反馈信号经过第三延迟单元再延迟一定时间后,形成低电平的复位信号,所述复位信号将所有的输出信号复位至低电平状态。
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