[发明专利]半导体器件隔离侧墙制造方法在审

专利信息
申请号: 201811607276.0 申请日: 2018-12-27
公开(公告)号: CN109686665A 公开(公告)日: 2019-04-26
发明(设计)人: 任佳;韩朋刚;孙文彦;康天晨 申请(专利权)人: 上海华力集成电路制造有限公司
主分类号: H01L21/311 分类号: H01L21/311
代理公司: 上海浦一知识产权代理有限公司 31211 代理人: 焦天雷
地址: 201315 上海市浦东新区中国(上*** 国省代码: 上海;31
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摘要:
搜索关键词: 隔离侧墙 牺牲层 刻蚀 形貌 侧墙 半导体器件 去除 制造 半导体隔离 覆盖隔离 器件隔离 器件性能 非对称 均一性 下层 制作
【说明书】:

发明公开了一种半导体器件隔离侧墙制造方法,包括:制作半导体隔离侧墙spacer,制作牺牲层覆盖隔离侧墙spacer,进行第一次牺牲层刻蚀去除部分牺牲层,进行隔离侧墙刻蚀形成设计形貌的隔离侧墙spacer,进行第二次牺牲层刻蚀去除全部牺牲层。本发明在器件隔离侧墙制造完成后通过刻蚀使隔离侧墙形成方形形貌能避免非对称形貌隔离侧墙对下层layer刻蚀的影响,提高器件的均一性,提高器件性能。

技术领域

本发明涉及半导体领域,特别是涉及一种半导体器件隔离侧墙制造方法。

背景技术

对于高容量的半导体存储装置需求的日益增加,这些半导体存储装置的集成密度受到人们的关注,为了增加半导体存储装置的集成密度,现有技术中采用了许多不同的方法,例如通过减小晶片尺寸和/或改变内结构单元而在单一晶片上形成多个存储单元,对于通过改变单元结构增加集成密度的方法来说,已经进行尝试沟通过改变有源区的平面布置或改变单元布局来减小单元面积。

Nand-flash存储器是flash存储器的一种,其内部采用非线性宏单元模式,为固态大容量内存的实现提供了廉价有效的解决方案。NAND闪存是一种比硬盘驱动器更好的存储方案,由于NAND闪存以页为单位读写数据,所以适合于存储连续的数据,如图片、音频或其他文件数据;同时因其成本低、容量大且写入速度快、擦除时间短的优点在移动通讯装置及便携式多媒体装置的存储领域得到广泛的应用。目前,为了提高NAND闪存的容量,需要在制备过程中提高NAND闪存的集成密度。NAND Flash的数据是以bit的方式保存在最小操作擦写读单元memory cell,简称cell,一般来说,一个最小操作擦写读单元CELL中只能存储一个bit。这些最小操作擦写读单元CELL以8个或者16个为单位,连成bit line,形成所谓的byte(x8)/word(x16),这就是NAND Device的位宽。这些Line会再组成Page。具体一片flash上有多少个Block视需要所定。

Nand-flash存储器具有容量较大,改写速度快等优点,适用于大量数据的存储,因而在业界得到了越来越广泛的应用,如嵌入式产品中包括数码相机、MP3随身听记忆卡、体积小巧的U盘等。

在制备NAND闪存过程中,间隔物图案化技术(Spacer patterning technology,SPT)以及自对准双图案技术(self aligned double patterning,SADP)均可以用来制备纳米尺度的晶体管,采用所述方法处理半导体的晶片时通常使用公知的图案化和蚀刻工艺在晶片中形成半导体器件的特征,在这些光刻工艺中,光刻胶材料沉积在晶片上,然后暴露于经过中间掩膜过滤的光线,通过中间掩膜后,该光线接触该光刻胶材料的表面,该光线改变该光刻胶材料的化学成分从而显影机可以去除该光刻胶材料的一部分,得到所需要的图案,

20nm NAND在2X generation节点下,由于ArF的曝光极限,AA/GT/CM2loop的最小操作擦写读单元cell区采用自对准双图案工艺SADP技术来形成最终图形pattern。传统的隔离侧墙刻蚀spacer etch后的不对称形貌会影响后续层刻蚀layer etch制程中等离子体plasma的方向性,导致尺寸偏移pitch-walking现象的产生,造成器件均一性差,影响器件性能。

发明内容

本发明要解决的技术问题是提供一种能避免隔离侧墙形貌对下层刻蚀造成影响的半导体器件隔离侧墙制造方法。

为解决上述技术问题,本发明提供的半导体器件隔离侧墙制造方法,包括以下步骤:

1)制作半导体隔离侧墙spacer;

2)制作牺牲层覆盖隔离侧墙spacer

3)进行第一次牺牲层刻蚀去除部分牺牲层;

4)进行隔离侧墙刻蚀形成设计形貌的隔离侧墙spacer;

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