[发明专利]一种基于DSP的LTE快速解码系统及其方法有效

专利信息
申请号: 201811362733.4 申请日: 2018-11-16
公开(公告)号: CN109257146B 公开(公告)日: 2020-11-24
发明(设计)人: 魏建勇;叶猛 申请(专利权)人: 武汉虹旭信息技术有限责任公司
主分类号: H04L1/00 分类号: H04L1/00
代理公司: 武汉宇晨专利事务所 42001 代理人: 黄瑞棠
地址: 430205 湖北省武汉市江*** 国省代码: 湖北;42
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摘要:
搜索关键词: 一种 基于 dsp lte 快速 解码 系统 及其 方法
【说明书】:

发明公开了一种基于DSP的LTE快速解码系统及其方法,涉及移动通信领域中的快速解码技术。本系统包括数据源(00)、前置处理器(10)、反向映射表生成器(20)和解速率匹配处理器(30);数据源(00)、前置处理器(10)、反向映射表生成器(20)和解速率匹配处理器(30)依次连通,前置处理器(10)和数据源(00)分别与解速率匹配处理器(30)连通。本发明使LTE终端在低内存下也能快速进行解速率匹配及解Turbo码交织,具有速率高、占用内存小和通用性强的优势。

技术领域

本发明涉及移动通信领域中的快速解码技术,尤其涉及一种基于DSP的LTE快速解码系统及其方法。

背景技术

随着LTE网络的迅猛发展,LTE终端的尺寸越来越小,功耗越来越低。终端上的基带处理芯片的核心、内存在逐渐降低。

对于LTE终端来说需要在1ms内处理完所有的PDSCH解析,随着业务信息速度越来越快,相同时间内处理的数据量越来越大,要求终端的处理能力大幅度上升。解速率匹配和Turbo码解交织部分是解码算法时间开销较大的几个部分,如果使用传统的解码方式,这几个模块步骤简单,思路清晰,但是时间开销相当大;如果使用空间转换提升效率,降低时间开销,但是由于巨大的数据吞吐量导致需要更多的内存,从而增加了硬件成本和芯片面积。

可见用传统的解码方法不能同时提高解码效率和降低芯片内存。

发明内容

本发明的目的在于使用较低内存的基础上同时提高LTE解速率匹配和Turbo解交织效率,提供一种基于DSP的LTE快速解码系统及其方法,实现快速解速率匹配及快速Turbo码解交织。

实现本发明目的的技术方案是:

选定的DSP平台为TI的C66xx芯片,主频为1GHz;使用该芯片完成解速率匹配及Turbo码解交织功能,使用芯片自带的Turbo码协处理器完成Turbo解码。

一、基于DSP的LTE快速解码系统(简称系统)

包括数据源、前置处理器、反向映射表生成器和解速率匹配处理器;

其连接关系是:

数据源、前置处理器、反向映射表生成器和解速率匹配处理器依次连通,前置处理器和数据源分别与解速率匹配处理器连通。

数据源将数据和参数送给前置处理器;

前置处理器进行参数计算,将基本表送到反向映射表生成器,将其他参数送到解速率匹配处理器;

反向映射表生成器计算反向映射表,把结果送入解速率匹配处理器;

解速率匹配处理器使用反向映射表生成器生成的表和前置处理器计算的参数,将数据源转换成输出结果,最后实现LTE的解速率匹配及Turbo码解交织。

二、基于DSP的LTE快速解码方法(简称方法)

本方法包括下列步骤:

①首先读取数据源送来的数据及参数,送到前置处理器,前置处理器首先计算交织码表参数和RM参数:N_D、D、K0、NIR,然后将参数送入系统比特基本表计算模块、第一交验比特基本表计算模块和第二交验比特基本表计算模块,计算出三种比特的基本表;

N_D为Turbo编码中子块交织器增加的虚拟比特个数;

D为Turbo编码中子块交织器输入比特数;

K0为Turbo编码中速率匹配模块的输出序列对应于输入序列的起始偏移值;

NIR为Turbo编码中传输块软缓存的比特长度;

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