[发明专利]一种半导体存储器及其制造方法有效
申请号: | 201811198296.7 | 申请日: | 2018-10-15 |
公开(公告)号: | CN109346475B | 公开(公告)日: | 2021-06-04 |
发明(设计)人: | 刘峻;霍宗亮 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L27/1157 | 分类号: | H01L27/1157;H01L27/11578;H01L27/11563 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 赵秀芹;王宝筠 |
地址: | 430074 湖北省武汉市东湖*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 一种 半导体 存储器 及其 制造 方法 | ||
1.一种半导体存储器的制造方法,其特征在于,包括:
在衬底上形成第一堆叠结构,所述第一堆叠结构包括贯穿所述第一堆叠结构的第一沟道孔,所述第一沟道孔内形成有存储器的功能层;所述第一堆叠结构由层间绝缘层和牺牲层交替层叠构成;
刻蚀所述第一沟道孔中的存储器的功能层和所述第一堆叠结构,以在所述第一沟道孔的顶部形成开口,所述开口的底表面低于顶层牺牲层的下表面;
在所述开口内形成插塞结构,所述插塞结构与第一沟道孔的功能层连接;
形成覆盖所述第一堆叠结构及所述插塞结构的第二堆叠结构,所述第二堆叠结构包括贯穿所述第二堆叠结构的第二沟道孔,所述第二沟道孔内形成有存储器的功能层;所述第二沟道孔内的功能层通过所述插塞结构与第一沟道孔的功能层连接;
将所述牺牲层替换为栅材料层,其中顶层的栅极层形成栅连接层。
2.根据权利要求1所述的方法,其特征在于,所述刻蚀所述第一沟道孔中的存储器的功能层和第一堆叠结构,以在所述第一沟道孔的顶部形成开口,具体包括:
干法刻蚀所述第一沟道孔中的存储器的功能层,以在所述第一沟道孔的顶部形成开口;
通过所述开口横向刻蚀所述顶层牺牲层,使所述开口的横向尺寸大于所述第一沟道孔的径向尺寸。
3.根据权利要求1或2所述的方法,其特征在于,在所述第一沟道孔的顶部形成开口之后,在所述开口内形成插塞结构之前,还包括:
在顶层牺牲层的侧壁形成栅氧化层。
4.根据权利要求2所述的方法,其特征在于,所述通过所述开口横向刻蚀所述顶层牺牲层,具体包括:
采用湿法腐蚀方法通过所述开口横向腐蚀所述顶层牺牲层。
5.根据权利要求1或2所述的方法,其特征在于,所述栅材料层的材料为金属栅材料。
6.根据权利要求5所述的方法,其特征在于,所述金属栅材料为金属钨。
7.根据权利要求1或2所述的方法,其特征在于,所述插塞结构的材料为未掺杂或低掺杂多晶硅,所述低掺杂多晶硅的掺杂浓度不高于1019cm-3。
8.根据权利要求1所述的方法,其特征在于,形成插塞结构之后,形成第二堆叠结构之前,还包括:
在所述插塞结构的上方形成刻蚀阻挡层;
所述形成覆盖所述第一堆叠结构及所述插塞结构的第二堆叠结构,具体包括:
在所述插塞结构以及所述第一堆叠结构的上方形成第二堆叠结构;
刻蚀位于所述第一沟道孔上方的第二堆叠结构直至到达所述刻蚀阻挡层,形成第二沟道孔;
去除所述刻蚀阻挡层,以使所述第二沟道孔与所述插塞结构接触连接;
在所述第二沟道孔内形成存储器的功能层。
9.根据权利要求1所述的方法,其特征在于,形成第二堆叠结构之后,将所述顶层牺牲层替换为栅材料层之前,还包括:
在所述第二沟道孔内且靠近所述第二沟道孔上表面区域形成漏极塞,所述漏极塞与所述第二沟道孔内的沟道层接触连接,所述功能层包括所述沟道层。
10.根据权利要求1所述的方法,其特征在于,在形成第二堆叠结构之前,还包括:
去除位于所述第一堆叠结构顶层的顶层层间绝缘层。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的