[发明专利]时钟占空比调整器

说明书

本发明公开了一种时钟占空比调整器，包括：占空比调整电路，模拟电压比较器、二分频电路、控制逻辑电路和占空比‑电压转换电路；所述占空比调整电路由第三PMOS晶体管，第三NMOS晶体管，多个由一PMOS晶体管和一电子开关串联组成的单元结构，以及第一电容组成；所述多个单元结构按编号从小到大，依次并联连接在电源电压VDD与调整后的时钟信号CKT输出端之间；其中多个单元结构中的PMOS晶体管的源极与电源电压VDD端相连接，其栅极输入待调整时钟信号CKIN，其漏极与电子开关的一端相连接，电子开关的另一端与CKT输出端相连接；第一电容连接在CKT输出端与地之间。本发明能自动调整时钟的占空比为50％。

技术领域

本发明涉及半导体集成电路领域，特别是涉及一种时钟占空比调整器。

背景技术

时钟占空比是一个很重要的技术指标。一般地，50％的占空比对于数据处理最有力，是系统稳定工作的保证。特别是同时使用上升沿和下降沿进行数据处理的系统，要求具有50％占空比的时钟信号，否则将会降低系统的数据处理能力。

发明内容

本发明要解决的技术问题是提供一种时钟占空比调整器，能自动调整时钟的占空比为50％。

为解决上述技术问题，本发明的时钟占空比调整器，包括：占空比调整电路，模拟电压比较器、二分频电路、控制逻辑电路和占空比-电压转换电路；

所述占空比调整电路，对输入的待调整时钟CKIN进行调整，生成调整后的时钟信号CKT；

所述二分频电路，将待调整时钟CKIN生成为50％占空比的时钟，作为参考时钟信号CKR；

所述占空比-电压转换电路，对调整后的时钟信号CKT进行转换，生成待调整时钟占空比积分电压信号VCT；对参考时钟信号CKR进行转换，生成参考时钟占空比积分电压VCR；

所述模拟电压比较器，对输入的电压VCT和VCR进行比较，并输出比较结果CMPO；

所述控制逻辑电路，根据比较结果CMPO生成N比特的占空比调整开关量，控制占空比调整电路内电子开关达到调整目标；其中，N为大于等于0的整数；

所述占空比调整电路由第三PMOS晶体管，第三NMOS晶体管，多个由一PMOS晶体管和一电子开关串联组成的单元结构，以及第一电容组成；

多个单元结构中的电子开关分别记为SW0…SWn，PMOS晶体管分别记为P0…Pn；n为大于等于0的整数，且n＝N；

PMOS晶体管PM3的源极与电源电压VDD端相连接，PMOS晶体管PM3的漏极与NMOS晶体管NM3的漏极相连接，其连接的节点作为作为调整后的时钟信号CKT输出端，NMOS晶体管NM3的源极接地，PMOS晶体管PM3的栅极和NMOS晶体管NM3的栅极相连接，输入待调整时钟信号CKIN；

所述多个单元结构按编号从小到大，依次并联连接在电源电压VDD与调整后的时钟信号CKT输出端之间；其中多个单元结构中的PMOS晶体管的源极与电源电压VDD端相连接，其栅极输入待调整时钟信号CKIN，其漏极与电子开关的一端相连接，电子开关的另一端与调整后的时钟信号CKT输出端相连接；

第一电容连接在调整后的时钟信号CKT输出端与地之间。

本发明使用数字模拟混合电路结构自动调整时钟的占空比为50％。

本发明的电路结构灵活，数字化设计，可以根据占空比调整需求，扩展数字位宽和占空比调整电路内相应模拟电路的数量达到调整精度要求。

附图说明

下面结合附图与具体实施方式对本发明作进一步详细的说明：

图1是时钟占空比调整器一实施例原理图；