[发明专利]处理被处理体的方法有效
申请号: | 201810971378.4 | 申请日: | 2018-08-24 |
公开(公告)号: | CN109427561B | 公开(公告)日: | 2023-07-07 |
发明(设计)人: | 田端雅弘;久松亨;木原嘉英 | 申请(专利权)人: | 东京毅力科创株式会社 |
主分类号: | H01L21/033 | 分类号: | H01L21/033;H01L21/311;H01L21/67 |
代理公司: | 北京尚诚知识产权代理有限公司 11322 | 代理人: | 龙淳;何中文 |
地址: | 日本*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 处理 方法 | ||
1.一种处理被处理体的方法,在该被处理体的表面设有多个孔,该方法的特征在于:
所述多个孔包括第一孔和孔宽大于所述第一孔的第二孔,令所述第二孔的孔宽与所述第一孔的孔宽之差为第一孔宽差,
所述方法包括第一流程,该第一流程包括:
在所述孔的内表面形成膜,形成在所述第一孔的内表面的膜的膜厚小于形成在所述第二孔的内表面的膜的膜厚的第一工序;和
各向同性地对形成在所述孔的内表面的膜进行蚀刻的第二工序,
令所述第二工序结束时的所述第二孔的孔宽与所述第一孔的孔宽之差为第二孔宽差时,所述第二孔宽差小于所述第一孔宽差,
所述第一工序包括使用等离子体CVD法的成膜处理,
所述膜含有硅。
2.如权利要求1所述的方法,其特征在于,
反复执行所述第一流程。
3.一种处理被处理体的方法,在该被处理体的表面设有多个孔,该方法的特征在于:
包括第一流程,该第一流程包括:
在所述孔的内表面形成膜的第一工序;和
各向同性地对所述膜进行蚀刻的第二工序,
所述第一工序包括使用等离子体CVD法的成膜处理,
所述膜含有硅,
所述第二工序反复执行包括第三工序、第四工序、第五工序和第六工序的第二流程,其中,
所述第三工序在收纳有所述被处理体的等离子体处理装置的处理容器内生成第一气体的等离子体,在所述孔的所述内表面的原子层各向同性地形成混合层,该混合层包含该第一气体的等离子体中所含的离子,
所述第四工序在执行所述第三工序后,对所述处理容器内的空间进行吹扫,
所述第五工序在执行所述第四工序后,在所述处理容器内生成第二气体的等离子体,并利用该第二气体的等离子体中所包含的自由基除去所述混合层,
所述第六工序在执行所述第五工序后,对所述处理容器内的空间进行吹扫,
所述第二工序通过反复执行所述第二流程,以逐次除去原子层的方式除去所述膜,来各向同性地对该膜进行蚀刻,
所述第一气体包含氮,
所述第二气体包含氟,
在所述第五工序中生成的所述第二气体的等离子体包含用于除去所述混合层的所述自由基,其中所述混合层包含硅的氮化物。
4.如权利要求3所述的方法,其特征在于,
所述第二气体为包含NF3气体和O2气体的混合气体。
5.如权利要求3所述的方法,其特征在于,
所述第二气体为包含NF3气体、O2气体、H2气体和Ar气体的混合气体。
6.如权利要求3所述的方法,其特征在于,
所述第二气体为包含CH3F气体、O2气体和Ar气体的混合气体。
7.一种处理被处理体的方法,在该被处理体的表面设有多个孔,该方法的特征在于:
包括第一流程,该第一流程包括:
在所述孔的内表面形成膜的第一工序;和
各向同性地对所述膜进行蚀刻的第二工序,
所述第一工序包括使用等离子体CVD法的成膜处理,
所述膜含有硅,
所述膜包括第一膜和第二膜,
所述第一工序包括:
第一膜形成工序,在所述孔的内表面形成所述第一膜;和
第二膜形成工序,在所述第一膜上形成所述第二膜,
所述第一膜与所述第二膜相比,对所述第二工序中执行的蚀刻的耐蚀刻性较低。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造