[发明专利]一种具有多晶硅岛的金属氧化物半导体二极管在审

专利信息
申请号: 201810970628.2 申请日: 2018-08-24
公开(公告)号: CN109119488A 公开(公告)日: 2019-01-01
发明(设计)人: 李泽宏;杨梦琦;蒲小庆;任敏;张金平;高巍;张波 申请(专利权)人: 电子科技大学
主分类号: H01L29/861 分类号: H01L29/861;H01L29/06
代理公司: 成都点睛专利代理事务所(普通合伙) 51232 代理人: 孙一峰
地址: 611731 四川省*** 国省代码: 四川;51
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摘要:
搜索关键词: 金属氧化物半导体二极管 多晶硅岛 横向电场 负电荷 功率半导体技术 半导体二极管 反向耐压 反向阻断 矩形分布 纵向电场 多晶硅 高电位 漂移区 耗尽 存储
【说明书】:

本发明设计功率半导体技术,特别涉及一种金属氧化物半导体二极管。本发明的有益效果为:在原专利提出的新型半导体二极管的基础上,在纵向方向添加了三个或三个以上的多晶硅岛,多晶硅岛中存储有负电荷,器件反向阻断时,高电位的N型区与多晶硅岛内的负电荷产生横向电场,辅助耗尽漂移区,使得横向电场分布更加均匀,纵向电场更加接近矩形分布,提高金属氧化物半导体二极管的反向耐压。

技术领域

本发明涉及功率半导体技术,特别涉及一种金属氧化物半导体二极管。

背景技术

在电子电路中,二极管是最常用的电子元件之一,传统的整流二极管主要是肖特基整流器和PN结整流器。其中,PN结二极管能够承受较高的反向阻断电压,稳定性较好,但是其正向导通压降较大,反向恢复时间较长。肖特基二极管是利用金属与半导体接触形成的金属-半导体结原理制作的,通态压降较低。由于是单极载流子导电,肖特基二极管在正向导通时没有过剩的少数载流子积累,反向恢复较快。但是肖特基二极管的反向击穿电压较低,反向漏电流较大,温度特性较差。为了提高二极管的性能,国内外研究者们一直试图结合PN结二极管和肖特基二极管的优点,提出了P-i-N二极管、结势垒控制整流器JBS(Junction Barrier Schottky Rectifier)、MOS控制二极管MCD(MOS Controlled Diode)、槽栅MOS势垒肖特基二极管TMBS(Trench MOS Barrier Schottky Diode)等器件。快恢复二极管具有较好的开关特性、较短的反向恢复时间,它内部结构与普通的额PN结不同,属于P-i-N二极管,在P型材料和N型材料之间添加了i基区,由于基区很薄,反向恢复电荷很小,所以快恢复二极管的反向恢复时间较短,正向压降较低,反向击穿电压较高。

专利“浅槽金属氧化物二极管(CN102064201A)”提出了一种新型的半导体二极管器件,结合了电子积累层和结型场效应管结构,获得了非常低的导通压降,大大提高了击穿电压并且降低了泄漏电流。然而,浅槽金属氧化物二极管和肖特基二极管一样是多子型器件,其反向耐压的提高与正向导通压降的降低存在矛盾,提高器件的反向耐压,就需要增加漂移区的厚度,减小漂移区的掺杂浓度,这些因素都会增加正向导通压降,这限制了该器件在中高压应用领域的应用。

发明内容

针对上述问题,本发明所要解决的问题是:解决浅槽金属氧化物二极管在正向导通压降较低时反向耐压不高的问题,使得浅槽金属氧化物二极管在保证较低正向导通压降的同时,实现较高的反向耐压。

为实现上述发明目的,本发明技术方案如下:

一种具有多晶硅岛的金属氧化物半导体二极管,包括从下至上依次层叠设置的阴极电极1、N+衬底2、N型漂移区3、N-掺杂区4以及阳极电极9;所述阴极电极1的上表面与N+衬底2的下表面接触,所述N+衬底2的上表面与N型漂移区3的下表面接触,所述阳极电极9的两端垂直向下延伸入N-掺杂区4中,N-掺杂区4与阳极电极9向下延伸的部分之间具有N型重掺杂区5;两侧的N型重掺杂区5之间的N-掺杂区4上表面具有平面栅结构,所述平面栅结构位于阳极电极9中,所述平面栅结构包括栅氧化层10和位于栅氧化层10上表面的多晶硅栅电极11,栅氧化层10下表面与部分N型重掺杂区5上表面接触;所述阳极电极9向下延伸部分的下方具有相互并列设置的沟槽8和P型重掺杂区6,且P型重掺杂区6的部分上表面与N型重掺杂区5接触;所述沟槽8垂直延伸入N型漂移区3中,所述P型重掺杂区6的下表面与N型漂移区3上表面之间具有P型埋层7,且P型埋层7的侧面与沟槽8接触,其特征在于:所述沟槽8中填充有介质层13,所述介质层13中具有多晶硅岛12,所述多晶硅岛12沿着纵向方向等间距排列,所述多晶硅岛12中存储有负电荷,且负电荷沿着阳极电极9到阴极电极1的方向逐渐增加。

进一步地,所述P型埋层7的掺杂浓度大于N-掺杂区4的掺杂浓度两个数量级,所述N型漂移区3的掺杂浓度大于N-掺杂区4的掺杂浓度一到两个数量级;

进一步地,所述栅氧化层10是薄栅氧化层,其厚度为5nm-100nm;

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