[发明专利]一种嵌入式移动图形处理器的纹理Cache及处理方法有效
| 申请号: | 201810753593.7 | 申请日: | 2018-07-10 | 
| 公开(公告)号: | CN109118422B | 公开(公告)日: | 2023-05-05 | 
| 发明(设计)人: | 蒋林;韩孟桥;杨博文;山蕊;田汝佳;耿玉荣 | 申请(专利权)人: | 西安科技大学 | 
| 主分类号: | G06T1/60 | 分类号: | G06T1/60;G06T1/20 | 
| 代理公司: | 北京金智普华知识产权代理有限公司 11401 | 代理人: | 张晓博 | 
| 地址: | 710054 *** | 国省代码: | 陕西;61 | 
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| 摘要: | |||
| 搜索关键词: | 一种 嵌入式 移动 图形 处理器 纹理 cache 处理 方法 | ||
1.一种嵌入式移动图形处理器的纹理Cache的处理方法,其特征在于,所述嵌入式移动图形处理器的纹理Cache的处理方法中,计算出d值后,在d值上下两个层级不同分辨率的纹理中分别提取4个纹理坐标进行双线性滤波,然后再对结果进行加权;
具体包括:
通过输入的读请求地址得出纹素所处的层级数,把读地址作为基地址,并在d值上下两个层级不同分辨率下计算出另外3个纹素的偏移地址,把4个纹素的地址在标记位比较电路中进行命中判断;如果4个纹素全部命中,则1拍或2拍直接从data_ram中输出给着色器;
有2个纹素命中,2个纹素不命中,在开始工作fifo中还没有数据时,data_ram等待数据写入fifo后一起分别输出2个纹素给着色器,并通过lru替换电路对data_ram进行更新;
4个纹素都不命中,则直接从fifo中输出4个纹素给着色器。
2.一种实现权利要求1所述嵌入式移动图形处理器的纹理Cache的处理方法的信息数据处理终端。
3.一种计算机可读存储介质,包括指令,当其在计算机上运行时,使得计算机执行如权利要求1所述的嵌入式移动图形处理器的纹理Cache的处理方法。
4.一种如权利要求1所述嵌入式移动图形处理器的纹理Cache的处理方法的嵌入式移动图形处理器的纹理Cache,其特征在于,所述嵌入式移动图形处理器的纹理Cache包括:
lut查找电路U0,用于负责对着色器输入的读请求地址进行解析;
地址判断电路U1,用于负责计算出双线性滤波中其余纹素在外存中的偏移地址;
标记位比较电路U2,用于负责判断纹理Cache是否命中;
lru替换电路U3,用于负责在读不命中的情况下,判断出需要替换块的地址;
fifo控制电路U4,用于负责在不命中时,选择缓冲区的哪一行进行输出;
输出电路U5,用于负责与外部的数据交互及纹理Cache中data_ram的读入。
5.如权利要求4所述的嵌入式移动图形处理器的纹理Cache,其特征在于,
lut查找电路U0对着色器输入的读请求地址进行解析中,包括:
通过d判断出2个相邻不同分辨率纹理所对应的层级数;着色器支持最大图像分辨率为1024×1024,对应层级数为0;依据金字塔中纹理图像大小需要满足2n×2n,则层级数为1对应的图像大小为512×512;以此类推,直到图像大小为1×1,层级数为10;并将层级数分别输出给模块地址判断电路U1、标记位比较电路U2、lru替换电路U3、输出电路U4。
6.如权利要求4所述的嵌入式移动图形处理器的纹理Cache,其特征在于,
地址判断电路U1计算出双线性滤波中其余纹素在外存中的偏移地址中,读取4个文纹素并进行加权,输入的读请求地址包括层级数的选择和纹素ID,共同决定纹素在外存中的起始地址addr0;通过对分辨率图像对应层级数的选择,判断出另外三个纹素的偏移地址oa1、oa2和oa3,并输出给标记位比较电路U2。
7.如权利要求4所述的嵌入式移动图形处理器的纹理Cache,其特征在于,
标记位比较电路U2判断纹理Cache是否命中,包括:由于4路组相联的映射关系,将256行Cache分成64组,其中每组又可以分成4路,将其每组第一路组成tag_ram0;每组第二路组成tag_ram1;每组第三路组成tag_ram2;每组第四路组成tag_ram3;根据读地址的检索位得到ram的组号,1拍并行判断出是否命中,命中则发送hit给输出电路U4;不命中则发送miss给lru替换电路U3,并发送读外存请求信号。
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