[发明专利]一种高可靠星载计算机程序存储设备在审
申请号: | 201810602293.9 | 申请日: | 2018-06-12 |
公开(公告)号: | CN108762970A | 公开(公告)日: | 2018-11-06 |
发明(设计)人: | 李超;王茂森;刘骁;吴杰;李毅;彭飞;柳宜川;滕树鹏 | 申请(专利权)人: | 上海航天计算机技术研究所 |
主分类号: | G06F11/07 | 分类号: | G06F11/07;G06F11/16;G06F15/17 |
代理公司: | 上海汉声知识产权代理有限公司 31236 | 代理人: | 胡晶 |
地址: | 200050 *** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 存储器 高可靠 星载 计算机程序存储 看门狗电路 存储 安全程序 程序存储 存储系统 复位控制 监控程序 控制时序 三模冗余 数据存储 应用程序 有效管理 驻留 匹配 衔接 计算机 | ||
1.一种高可靠星载计算机程序存储设备,其特征在于,包括CPU、FPGA、PROM、EEPROM、SRAM和看门狗电路;所述FPGA衔接所述CPU和各个存储器,用于匹配各个存储器的控制时序;所述PROM用于存储监控程序和安全程序,可维护最小的安全系统;所述EEPROM用于存储系统应用程序;计算机运行时,程序从所述EEPROM搬场到所述SRAM中,并驻留在所述SRAM中运行;EEPROM存储采用三模冗余的方式,对每一份数据存储在独立的三个所述EEPROM中;所述看门狗电路用于检测所述EEPROM的供电电压的变化,当低于预设的阈值时,将所述EEPROM置为复位状态,禁止读写操作。
2.根据权利要求1所述的一种高可靠星载计算机程序存储设备,其特征在于,所述CPU访问存储器均由所述FPGA进行地址译码选择控制,其中所述FPGA内部设计EEPROM指令序列锁时序匹配逻辑,输出时序反馈控制信号,所述CPU根据所述时序反馈控制信号调整自身的读写时序,实现与被访问存储器的时序匹配。
3.根据权利要求1所述的一种高可靠星载计算机程序存储设备,其特征在于,所述EEPROM在默认状态下处于写锁定状态,需对所述EEPROM发送写解锁指令序列,解锁EEPROM写锁定状态才能进行写操作。
4.根据权利要求1所述的一种高可靠星载计算机程序存储设备,其特征在于,所述FPGA内部设置预设的EEPROM写允许状态,用于开启EEPROM写信号,该状态位由地面指令控制,当处于EEPROM写允许状态时,发送预设写指令序列才能有效到达所述EEPROM,实现写操作。
5.根据权利要求1所述的一种高可靠星载计算机程序存储设备,其特征在于,在读取程序过程中,所述PROM读取三份EEPROM数据进行比对,三份数据一致时搬场到所述SRAM中运行;当存在一份EEPROM数据不同于另外两份EEPROM数据时,则判断两份相同的EEPROM数据正确,将正确数据搬场到所述SRAM中,同时判定另一份EEPROM数据错误,记录该份EEPROM数据错误的地址,择机处理;当存在三份EEPROM数据均不相同时,将停止搬场,记录错误,运行所述PROM中的最小系统程序。
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