[发明专利]集成电路以及静电放电保护电路有效
申请号: | 201810477845.8 | 申请日: | 2018-05-18 |
公开(公告)号: | CN110504251B | 公开(公告)日: | 2021-12-24 |
发明(设计)人: | 黄绍璋;叶家荣;周业宁;廖显峰;吴易翰;廖志成;庄介尧;陈伟松;陈敬文;陈邦权 | 申请(专利权)人: | 世界先进积体电路股份有限公司 |
主分类号: | H01L27/02 | 分类号: | H01L27/02 |
代理公司: | 北京三友知识产权代理有限公司 11127 | 代理人: | 王涛 |
地址: | 中国台湾新竹*** | 国省代码: | 台湾;71 |
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摘要: | |||
搜索关键词: | 集成电路 以及 静电 放电 保护 电路 | ||
本发明提出一种集成电路以及静电放电保护电路,其耦接一接合垫与一核心电路,且包括静电放电检测电路、放电电路以及开关。静电放电检测电路检测于接合垫上是否发生一静电放电事件以产生一第一检测信号。放电电路接收第一检测信号。当接合垫上发生静电放电事件,放电电路根据第一检测信号提供介于接合垫与一接地端之间的一放电路径。开关耦接于核心电路与接地端之间,且受控于第一检测信号。当于接合垫上发生静电放电事件,开关根据第一检测信号而关闭。本发明具有保护核心电路内的元件不受静电电荷的破坏及避免静电放电事件发生所导致的高电压让核心电路误操作的有益效果。
技术领域
本发明是有关于一种集成电路,特别是有关于一种具有静电放电保护电路的集成电路。
背景技术
集成电路随着半导体工艺的发展,元件尺寸已缩小至次微米阶段,以增进集成电路的性能以及运算速度,但元件尺寸的缩减,却出现了一些可靠度的问题,尤以集成电路对静电放电(Electrostatic Discharge,ESD)的防护能力影响最大。当元件尺寸由于先进的工艺技术而减小,静电放电的防护能力也降低许多,结果造成元件的ESD耐受力大幅降低。因此,需要静电放电保护电路来保护元件不受静电放电所损坏。
发明内容
因此,本发明提供一种静电放电保护电路,其耦接一接合垫与一核心电路,且包括静电放电检测电路、放电电路以及开关。静电放电检测电路检测于接合垫上是否发生一静电放电事件以产生一第一检测信号。放电电路接收第一检测信号。当接合垫上发生静电放电事件,放电电路根据第一检测信号提供介于接合垫与一接地端之间的一放电路径。开关耦接于核心电路与接地端之间,且受控于第一检测信号。当于接合垫上发生静电放电事件,开关根据第一检测信号而关闭。
在一实施例中,开关包括上述开关包括一N型晶体管,其具有耦接核心电路的第一端、耦接接地端的第二端以及接收第一检测信号的控制端。
在一实施例中,静电放电保护电路还包括一P型晶体管,其具有耦接接合垫的第一端、耦接核心电路的第二端以及控制端。当核心电路非处于正常操作模式时,此P型晶体管的控制端浮接。
本发明提供一种集成电路,其包括核心电路以及静电放电保护电路。核心电路耦接一接合垫,且具有耦接一接地端的一电源端。静电放电保护电路耦接一接合垫与核心电路。当于接合垫上发生一静电放电事件时,静电放电保护电路提供介于接合垫与接地端之间的一放电路径,且阻断电源端与接地端之间的一电流路径。静电放电保护电路包括静电放电检测电路、放电电路以及N型晶体管。静电放电检测电路检测于接合垫上是否发生静电放电事件以产生一检测信号。放电电路接收检测信号。当于接合垫上发生静电放电事件,放电电路根据检测信号提供放电路径。N型晶体管具有耦接核心电路的第一端、耦接接地端的第二端以及接收第一检测信号的控制端。当于接合垫上发生静电放电事件,第一N型晶体管根据检测信号而关闭以阻断电流路径。
在一实施例中,静电放电保护电路还包括一P型晶体管。此P型晶体管具有耦接接合垫的第一端、耦接核心电路的第二端以及控制端。当核心电路非处于一正常操作模式时,此P型晶体管的控制端浮接。
本发明所提出的静电放电保护电路在接合垫上发生静电放电事件时,不仅能提供接合垫与接地端之间的放电电流,也能阻断核心电路与接地端之间的电流路径。如此一来,能保护核心电路内的元件不受静电电荷的破坏,也能避免静电放电事件发生所导致的高电压让核心电路误操作。
附图说明
图1表示根据本发明一实施例,用于一集成电路的静电放电保护电路。
图2表示根据本发明另一实施例的静电放电保护电路。
图3表示根据本发明另一实施例的静电放电保护电路。
图4表示根据本发明又一实施例的静电放电保护电路。
图5表示根据本发明一实施例,用于一集成电路的静电放电保护电路。
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