[实用新型]一种降低集成电路封装内功率耗损的装置有效

专利信息
申请号: 201721160765.7 申请日: 2017-09-12
公开(公告)号: CN207265040U 公开(公告)日: 2018-04-20
发明(设计)人: 曹志军 申请(专利权)人: 深圳市思佳捷科技有限公司
主分类号: H01L23/32 分类号: H01L23/32
代理公司: 北京华识知识产权代理有限公司11530 代理人: 刘艳玲
地址: 518000 广东省深圳市*** 国省代码: 广东;44
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摘要:
搜索关键词: 一种 降低 集成电路 封装 功率 耗损 装置
【说明书】:

技术领域

实用新型是一种降低集成电路封装内功率耗损的装置,属于降低集成电路封装内功率耗损的装置领域。

背景技术

现有技术中,有各种利用上下桥两晶体管开关的切换,以提供输出电压的电路,例如各种切换式电源供应电路。

现有技术公开申请号为CN200820105543.X的一种降低集成电路封装内功率耗损的装置,本实用新型提出一种降低集成电路封装内功率耗损的装置,包含:集成电路,其内具有互相电连接的上下桥晶体管,和控制该上下桥晶体管的控制电路;以及位于集成电路外部的电阻,此电阻与该互相电连接的上下桥晶体管间的一节点电连接,或与该上桥晶体管的上端电连接。但是,现有技术设备不具有能够将低耗损磁芯片牢牢固定在集成电路板上的装置,光靠铝片焊接于集成电路板上易造成脱落,影响集成电路板色使用寿命。

实用新型内容

针对现有技术存在的不足,本实用新型目的是提供一种降低集成电路封装内功率耗损的装置,以解决现有技术不具有能够将低耗损磁芯片牢牢固定在集成电路板上的装置,光靠铝片焊接于集成电路板上易造成脱落,影响集成电路板色使用寿命的问题。

为了实现上述目的,本实用新型是通过如下的技术方案来实现:一种降低集成电路封装内功率耗损的装置,其结构包括底板、外壳、卡板,所述底板通过注塑连接于外壳底部,所述外壳通过注塑连接于底板上表面,所述卡板通过焊接于底板两端,所述底板设有芯片焊盘,所述芯片焊盘分别焊接于底板两端上表面上;所述外壳设有铜线,所述铜线均匀分布于外壳底部;所述卡板设有板体、固定板、卡槽,所述板体焊接于固定板与卡槽之间,所述固定板焊接于板体与芯片焊盘之间,所述卡槽焊接于板体底部。

进一步的,所述底板为多边形板状结构,底板设有凹槽,所述凹槽为圆形结构,所述凹槽嵌设于底板上表面,所述铜线通过凹槽嵌设于底板上表面。

进一步的,所述芯片焊盘为片状结构,所述芯片焊盘分为两片,所述芯片焊盘分别焊接于底板上表面,所述芯片焊盘焊接于底板两端上表面上。

进一步的,所述外壳为圆形结构,外壳设有底盘、连接柱,所述底盘为圆形结构,所述底盘垂直注塑连接于连接柱底部,所述连接柱为圆形柱状结构,所述连接柱通过注塑垂直连接于外壳与底盘之间。

进一步的,所述铜线为圆形线状结构,所述铜线缠绕成圆形结构,所述铜线通过连接柱过度配合连接于外壳上,所述铜线两端分别嵌设于底板与外壳上。

进一步的,所述固定板为矩形结构,固定板设有焊接孔,所述焊接孔为圆形结构,所述焊接孔均匀等距嵌设于固定板上,所述固定板通过铝片贯穿焊接孔焊接于底板两端。

进一步的,所述板体为矩形结构,所述板体垂直焊接于固定板与卡槽之间,所述板体为两块,所述板体分别垂直焊接于底板底部两端上。

有益效果

本实用新型的有益效果:通过设有一种卡板,通过将卡板嵌入集成电路板内部,再通过卡槽嵌设固定,够将低耗损磁芯片牢牢固定在集成电路板上,避免光靠铝片焊接于集成电路板上易造成脱落,影响集成电路板色使用寿命。

附图说明

通过阅读参照以下附图对非限制性实施例所作的详细描述,本实用新型的其它特征、目的和优点将会变得更明显:

图1为本实用新型一种降低集成电路封装内功率耗损的装置的结构示意图;

图2为本实用新型一种卡板的结构示意图。

图中:1-底板、2-外壳、3-卡板、10-芯片焊盘、20-铜线、30-板体、31-固定板、32-卡槽。

具体实施方式

为使本实用新型实现的技术手段、创作特征、达成目的与功效易于明白了解,下面结合具体实施方式,进一步阐述本实用新型。

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