[发明专利]一种采用音频接口的条码扫描器及其通讯方法有效

专利信息
申请号: 201711438185.4 申请日: 2017-12-27
公开(公告)号: CN107944323B 公开(公告)日: 2020-10-16
发明(设计)人: 唐丙振 申请(专利权)人: 管彦传
主分类号: G06K7/10 分类号: G06K7/10;G06K7/14
代理公司: 广州天河万研知识产权代理事务所(普通合伙) 44418 代理人: 刘强;陈轩
地址: 318050 浙江省*** 国省代码: 浙江;33
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摘要:
搜索关键词: 一种 采用 音频接口 条码 扫描器 及其 通讯 方法
【权利要求书】:

1.一种采用音频接口的条码扫描器,其特征在于:包括,

扫描模块(1),用于对条码进行扫描;

编码模块(2),用于将条码信息转化为二进制数据;

数据暂存模块(3),用于存储编码模块(2)输出的二进制数据;

封装模块(4),用于对二进制数据进行打包封装;

发送模块(5),与音频接口中的音频输出线路相连,用于向智能设备发送条码信息;

滤波模块(6),设置在发送模块(5)与智能设备之间,用于对通讯的数据进行过滤;

修正模块(7),与音频接口中的音频输入线路相连,用于从智能设备端读取条码信息,与数据暂存模块(3)内存储的条码信息进行比对,根据比对结果对滤波模块(6)的滤波参数进行修正;

所述滤波模块(6)的输入端(IN)通过串联的第一可变电容(VC1)和第二可变电容(VC2)连接至第一运放(A1)的正相输入端,第一运放(A1)的反相输入端通过第四电阻(R4)接地,第一运放(A1)的反相输入端通过第一可变电阻(VR1)连接至第一运放(A1)的输出端,输入端(IN)通过第一电阻(R1)和第二电阻(R2)连接至第一运放(A1)的正相输入端,第一电阻(R1)和第二电阻(R2)之间通过第一电容(C1)接地,第一可变电容(VC1)和第二可变电容(VC2)通过第三电阻(R3)接地,输入端(IN)通过第五电阻(R5)连接至第二运放(A2)的正相输入端,第二运放(A2)的正相输入端通过第八电阻(R8)接地,第一运放(A1)的输出端通过第六电阻(R6)连接至第二运放(A2)的反相输入端,第二运放(A2)的反相输入端通过第七电阻(R7)连接至第二运放(A2)的输出端,第二运放(A2)的输出端通过第二电容(C2)连接至三极管(Q)的基极,三极管(Q)的集电极通过第三电容(C3)连接至第一运放(A1)的输出端,三极管(Q)的发射极通过第九电阻(R9)接地,第一运放(A1)的输出端通过第十电阻(R10)连接至第三运放(A3)的正相输入端,第三运放(A3)的反相输入端通过第十一电阻(R11)接地,第三运放(A3)的反相输入端通过串联的第十二电阻(R12)和第十三电阻(R13)连接至第三运放(A3)的输出端,第十二电阻(R12)和第十三电阻(R13)之间通过第十四电阻(R14)接地,第三运放(A3)的输出端通过第四电容(C4)接地,第三运放(A3)的输出端通过第十五电阻(R15)连接至输出端(OUT)。

2.一种权利要求 1所述的采用音频接口的条码扫描器的通讯方法,其特征在于包括以下步骤:

A、扫描模块(1)对条码进行扫描;

B、编码模块(2)将条码信息转化为二进制数据;

C、将步骤B生成的二进制数据存入数据暂存模块(3);

D、封装模块(4)对二进制数据进行打包封装;

E、发送模块(5)向智能设备发送打包封装后的条码信息;

F、滤波模块(6)对通讯数据进行过滤,降低杂波干扰;

G、修正模块(7)从智能设备端读取条码信息,与数据暂存模块(3)内存储的条码信息进行比对,根据比对结果对滤波模块(6)的滤波参数进行修正。

3.根据权利要求 2所述的采用音频接口的条码扫描器的通讯方法,其特征在于:步骤D中,对数据进行打包包括以下步骤,

D1、将待发送数据进行分割,形成若干个数据段,在分割部位进行数据二次打包,及将分割部位的数据同时放入两个数据包中;

D2、对每个数据段进行封装,为每个数据包设定唯一的识别数据段,并在包含有相同数据的两个数据包中设定匹配数据段。

4.根据权利要求 3所述的采用音频接口的条码扫描器的通讯方法,其特征在于:步骤D1中,在将数据段放入数据包前,对数据段进行压缩处理,包括以下步骤,

D11、对数据段进行一级压缩,使用识别数据段的特征值作为一级压缩文件的特征值;

D12、对一级压缩文件进行二级压缩,使用匹配数据段的特征值作为二级压缩文件的特征值。

5.根据权利要求4所述的采用音频接口的条码扫描器的通讯方法,其特征在于:步骤E中,智能设备收到数据包后,进行解压缩,并根据识别数据段和匹配数据段对数据段进行重建,得到复原的条码信息。

6.根据权利要求2所述的采用音频接口的条码扫描器的通讯方法,其特征在于:步骤G中,修正模块(7)根据比对结果对第一可变电容(VC1)、第二可变电容(VC2)和第一可变电阻(VR1)进行调节。

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