[发明专利]一种大尺寸芯片曝光方法在审
申请号: | 201711385400.9 | 申请日: | 2017-12-20 |
公开(公告)号: | CN107894693A | 公开(公告)日: | 2018-04-10 |
发明(设计)人: | 戴鑫 | 申请(专利权)人: | 苏州工业园区纳米产业技术研究院有限公司 |
主分类号: | G03F7/20 | 分类号: | G03F7/20;G03F9/00 |
代理公司: | 苏州谨和知识产权代理事务所(特殊普通合伙)32295 | 代理人: | 唐静芳 |
地址: | 215000 江苏省苏州市苏州工业*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 一种 尺寸 芯片 曝光 方法 | ||
技术领域
本发明涉及一种半导体制造方法,具体涉及一种大尺寸芯片曝光方法。
背景技术
在现有半导体器件的生产中,曝光是其中非常重要的一个工艺。为保证后层图形与前层图形套准,前层图形必须设计对准标记,曝光机台对准系统自动扫描前层对位标记,可以精确定位前层图形位置,确保后续光刻图形与前层图形的套准精度。
曝光机台成像的大小有限制,即曝光机台存在视场的局限性,当客户要求制造的芯片尺寸大于曝光机台的视场时,目前有效的解决方案是更换更大视场的曝光机台。然而,为了获取更大视场,更换曝光机台的成本相当高,而如果不更换曝光机台,则无法满足大尺寸芯片的制造需求。
发明内容
本发明的目的在于提供一种具备较好通用性的大尺寸芯片曝光方法,可以在不更换现有曝光机台的情况下,对超出曝光机台正常视场的大尺寸芯片进行曝光。
为达到上述目的,本发明提供如下技术方案:一种大尺寸芯片曝光方法,包括:
将晶圆的待曝光区域进行虚拟划分,使得所述待曝光区域包括主芯片区、测试单元区和对位标记区,所述主芯片区包括多个子芯片区,所述测试单元区和所述对位标记区分别位于所述主芯片区的外围;
使用同一光罩,分别对所述主芯片区、所述测试单元区和所述对位标记区进行曝光,以在所述晶圆上获得预设尺寸的曝光图形;以及
对曝光后的所述晶圆进行拼接,得到目标需求的大尺寸主芯片。
优选的,所述测试单元区和所述对位标记区位于所述主芯片区的相同侧。
优选的,所述测试单元区和所述对位标记区位于所述主芯片区的不同侧。
优选的,所述主芯片区分别与所述测试单元区和所述对位标记区间隔设置。
优选的,所述测试单元区和所述对位标记区之间邻接。
优选的,所述子芯片区的其中一边尺寸为21-35mm。
优选的,所述测试单元区和所述对位标记区的尺寸相同或相异。
优选的,所述测试单元区和所述对位标记区至少之一的长度为5-10mm,宽度为5-15mm。
优选的,所述主芯片区与所述测试单元区和所述对位标记区至少之一的间隔为3-8mm。
优选的,所述光罩的活动范围小于曝光机台的尺寸范围。
优选的,位于所述测试单元区内的测试单元和位于所述对位标记区内的对位标记通过插花的形式曝光,且插花区域的尺寸小于或者等于所述子芯片区的尺寸。
本发明的有益效果在于:本发明的大尺寸芯片曝光方法可以满足不同尺寸的芯片需求,对于特殊图案的芯片可以通过插花形式完成曝光,而且不需要对现有机台进行更新换代,具有通用性较好和制造成本较低的优点。
上述说明仅是本发明技术方案的概述,为了能够更清楚了解本发明的技术手段,并可依照说明书的内容予以实施,以下以本发明的较佳实施例并配合附图详细说明如后。
附图说明
图1为本发明大尺寸芯片曝光方法一优选实施例的流程示意图。
图2为本发明大尺寸芯片曝光方法一优选实施例的晶圆虚拟划分区域示意图。
具体实施方式
下面结合附图和实施例,对本发明的具体实施方式作进一步详细描述。以下实施例用于说明本发明,但不用来限制本发明的范围。
本发明公开了一种大尺寸芯片曝光方法,可以在不更换现有曝光机台的情况下,对超出曝光机台正常视场的大尺寸芯片进行曝光。
请参阅图1,本发明大尺寸芯片曝光方法的一优选实施例包括:
将晶圆的待曝光区域进行虚拟划分,使得所述待曝光区域包括主芯片区、测试单元区和对位标记区,所述主芯片区包括多个子芯片区,所述测试单元区和所述对位标记区分别位于所述主芯片区的外围;
使用同一光罩,分别对所述主芯片区、所述测试单元区和所述对位标记区进行曝光,以在所述晶圆上获得预设尺寸的曝光图形;以及
对曝光后的所述晶圆进行拼接,得到目标需求的大尺寸主芯片。
在整个曝光过程中,所述光罩的活动范围均必需小于曝光机台的尺寸范围。
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