[发明专利]嵌入式闪存的制作方法有效
申请号: | 201711297481.7 | 申请日: | 2017-12-08 |
公开(公告)号: | CN108054167B | 公开(公告)日: | 2019-04-12 |
发明(设计)人: | 张超然;李赟;周俊 | 申请(专利权)人: | 武汉新芯集成电路制造有限公司 |
主分类号: | H01L27/115 | 分类号: | H01L27/115;H01L27/11521;H01L27/11531 |
代理公司: | 上海思微知识产权代理事务所(普通合伙) 31237 | 代理人: | 屈蘅;李时云 |
地址: | 430205 湖北*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 嵌入式 闪存 制作方法 | ||
1.一种嵌入式闪存的制作方法,其特征在于,包括:
提供一基底,所述基底上包括逻辑区和存储区,所述存储区形成有栅极结构,所述栅极结构包括位于其顶部的硬掩模层和位于其侧壁的侧墙;
形成导电层,所述导电层覆盖所述存储区和所述逻辑区;
形成光刻胶层,所述光刻胶层直接覆盖所述导电层,并且所述光刻胶层的表面平行于所述基底表面;
去除覆盖所述存储区和所述逻辑区的部分厚度的所述光刻胶层,暴露出部分所述导电层,所述部分导电层覆盖所述硬掩模层和部分所述侧墙;
以剩余厚度的所述光刻胶层作为光刻胶保护层,刻蚀所述导电层,暴露出所述硬掩模层和部分所述侧墙;以及
去除所述光刻胶保护层。
2.如权利要求1所述的嵌入式闪存的制作方法,其特征在于,所述栅极结构还包括沿所述基底表面依次形成的浮栅、极间介质层以及控制栅。
3.如权利要求1所述的嵌入式闪存的制作方法,其特征在于,在所述基底和所述栅极结构之间还形成有栅极氧化层,所述栅极结构位于所述栅极氧化层上方的高度是200~250nm。
4.如权利要求1所述的嵌入式闪存的制作方法,其特征在于,所述导电层包括多晶硅,所述导电层的厚度是40~60nm。
5.如权利要求1所述的嵌入式闪存的制作方法,其特征在于,利用旋涂法形成所述光刻胶层,所述光刻胶层包括正性光刻胶。
6.如权利要求1所述的嵌入式闪存的制作方法,其特征在于,去除部分所述光刻胶层利用各向异性干法刻蚀工艺。
7.如权利要求1所述的嵌入式闪存的制作方法,其特征在于,去除部分所述光刻胶层利用氧气灰化工艺。
8.如权利要求1所述的嵌入式闪存的制作方法,其特征在于,刻蚀所述导电层利用各向异性干法刻蚀工艺。
9.如权利要求1至8任一项所述的嵌入式闪存的制作方法,其特征在于,以剩余的所述光刻胶层作为光刻胶保护层,刻蚀所述导电层的步骤包括:使得剩余的所述导电层在所述逻辑区和所述存储区齐平。
10.如权利要求1至8任一项所述的嵌入式闪存的制作方法,其特征在于,所述嵌入式闪存的制作方法还包括:去除所述光刻胶保护层之后,刻蚀所述导电层,形成逻辑区的栅极以及存储区的选择栅和/或擦除栅。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的