[发明专利]数据存储装置在审

专利信息
申请号: 201711055987.7 申请日: 2010-04-01
公开(公告)号: CN107832010A 公开(公告)日: 2018-03-23
发明(设计)人: 阿尔贝特.T.博尔歇斯;罗伯特.S.斯普林科;安德鲁.T.斯温;贾森.W.克劳斯 申请(专利权)人: 谷歌有限责任公司
主分类号: G06F3/06 分类号: G06F3/06;G06F12/02
代理公司: 北京市柳沈律师事务所11105 代理人: 邵亚丽
地址: 美国加利*** 国省代码: 暂无信息
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摘要:
搜索关键词: 数据 存储 装置
【说明书】:

本申请是申请日为2010年4月1日、申请号为201080020506.9、发明名称为“数据存储装置”的PCT发明专利申请的分案申请。

相关申请案交叉参考

本申请案请求对在2009年4月8日提出申请且标题为“数据存储装置(DATA STORAGE DEVICE)”的第61/167,709号美国临时申请案及在2009年6月17日提出申请且标题为“快闪存储器数据存储装置中的分割及剥离(PARTITIONING AND STRIPING IN A FLASH MEMORY DATA STORAGE DEVICE)”的第61/187,835号美国临时申请案的权益,其两者以整体引用的方式并入本文中。

技术领域

本说明涉及一种数据存储装置。

背景技术

可使用数据存储装置来存储数据。数据存储装置可与计算装置一同使用以提供所述计算装置的数据存储需要。在某些实例中,可期望在数据存储装置上存储大量数据。此外,可期望快速地执行从所述数据存储装置读取数据及向所述数据存储装置写入数据的命令。

发明内容

本文件描述一种包括一个或一个以上存储器板的数据存储装置,其中所述存储器板中的每一者包括多个快闪存储器芯片。所述数据存储装置包括所述存储器板可操作地连接到的控制器板。所述数据存储装置可经配置以使用接口与主机进行通信以从所述主机接收命令且使用所述快闪存储器芯片来处理这些命令。举例来说,所述主机可发送且所述控制器板可接收用以使用所述快闪存储器芯片读取、写入、拷贝及擦除数据块的命令。

在一个示范性实施方案中,所述控制器包括现场可编程门阵列(FPGA)控制器且所述主机与所述控制器板之间的接口可为高速接口,例如(举例来说)外围组件互连高速(PCIe)接口。以此方式,所述数据存储装置可包括高存储体积且可经配置以实现所述主机与所述快闪存储器芯片之间的数据传送的高性能及高速度。

在一个示范性实施方案中,所述数据存储装置可经配置而具有两个存储器板,其中所述存储器板中的每一者包括多个快闪存储器芯片。包括所述控制器板及两个存储器板的所述数据存储装置可以磁盘驱动器形式配置,使得所述数据存储装置装配于计算装置的板上驱动槽中。举例来说,所述数据存储装置可经配置以装配于服务器的板上驱动槽中以为所述服务器提供数据存储容量。所述数据存储装置可经配置而为可抽换的,使得其可容易地从所述计算装置移除且插入于不同计算装置的板上驱动槽中。

此外,所述数据存储装置可为模块化,使得存储器板可与控制器板断开且由其它存储器板来替换,其中所述其它存储器板也可包括多个快闪存储器芯片。控制器板上的控制器可为可配置以辨识存储器板中的一者或一者以上已断开且由其它存储器板替换。所述控制器可经配置以辨识存储器板的此类型的换出且可处理主机与所述其它存储器板之间的命令。以此方式,即使存储器板中的一者或一者以上不再可用,控制器板也可继续使用。不可用的存储器板可与控制器板断开且可由另一存储器板替换,同时仍使用同一控制器板及所述控制器板上的相同组件。

在一个示范性实施方案中,所述数据存储装置可为可配置以处置不同类型的快闪存储器芯片。举例来说,控制器板上的控制器可经配置以辨识存储器板上的不同类型的快闪存储器芯片并与其一同操作。举例来说,所述控制器可为FPGA控制器,其经配置以辨识不同类型的快闪存储器芯片,其中包括(举例来说)单电平单元(SLC)快闪存储器芯片、多电平单元(MLC)快闪存储器芯片、NAND快闪存储器芯片、NOR快闪存储器芯片及其它类型的快闪存储器芯片。所述控制器可经配置以辨识来自不同快闪存储器芯片销售商的快闪存储器芯片。所述控制器可经配置以辨识所述不同类型的快闪存储器芯片且通过基于存储器板上的快闪存储器芯片的类型翻译来自主机的命令而使用所述快闪存储器芯片来执行所述命令。因此,由于快闪存储器芯片的所述类型,不需要主机来翻译所述命令或发送不同命令。所述控制器可经配置以针对所述特定类型的快闪存储器芯片将来自主机的所述命令翻译成本机命令。

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