[发明专利]像素结构及其驱动方法、显示装置在审

专利信息
申请号: 201710745250.1 申请日: 2017-08-25
公开(公告)号: CN107331342A 公开(公告)日: 2017-11-07
发明(设计)人: 高坤坤;王瑞;毛大龙;黄中浩;赵永亮 申请(专利权)人: 京东方科技集团股份有限公司;重庆京东方光电科技有限公司
主分类号: G09G3/20 分类号: G09G3/20;G09G3/36
代理公司: 北京中博世达专利商标代理有限公司11274 代理人: 申健
地址: 100015 *** 国省代码: 北京;11
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摘要:
搜索关键词: 像素 结构 及其 驱动 方法 显示装置
【说明书】:

技术领域

发明涉及显示技术领域,尤其涉及一种像素结构及其驱动方法、显示装置。

背景技术

显示装置是一种用于显示文字、数字、符号、图片,或者由文字、数字、符号和图片中至少两种组合形成的图像等画面的装置,为人们的生活、工作提供较大的便利性。现有的一种显示装置通常包括显示面板,显示面板内设置有包括呈阵列排布的多个像素单元的像素结构,通过使像素结构中各像素单元显示不同灰度,实现显示装置的画面显示。

在现有的像素结构中,像素单元均包括像素电极和公共电极,通过分别向像素电极和公共电极施加电压,使像素电极与公共电极之间产生电压差,使像素单元进行显示,实现显示装置的显示。向公共电极施加电压时,通常向各像素单元的公共电极施加相同的电压,然而,由于现有的像素结构的结构设计限制,造成各像素单元的公共电极的电压不均匀,从而引起显示装置的画面显示质量降低,例如,出现闪烁、闪绿、残像等不良。

发明内容

本发明的目的在于提供一种像素结构,用于改善显示装置的画面显示质量。

为了实现上述目的,本发明提供如下技术方案:

一种像素结构,包括多个像素单元,每个所述像素单元均包括第一薄膜晶体管、像素电极和公共电极,且至少一个所述像素单元还包括第二薄膜晶体管,其中,所述像素单元的第一薄膜晶体管与该像素单元的像素电极连接;所述像素单元的第二薄膜晶体管与该像素单元的公共电极连接。

优选地,多个所述像素单元呈N×M阵列排布;所述像素结构还包括交叉限定出多个像素区的多条栅线和多条数据线,所述每个像素单元位于对应的所述像素区内,所述栅线的数量为N+1条,所述数据线的数量为M条;第i行所述像素单元中,所述像素单元的第一薄膜晶体管的栅极与第i条所述栅线连接,所述像素单元的第二薄膜晶体管的栅极与第i+1条所述栅线连接,其中,1≤i≤N。

优选地,多个所述像素单元呈N×M阵列排布;所述像素结构还包括交叉限定出多个像素区的多条栅线和多条数据线,所述每个像素单元位于对应的所述像素区内,所述栅线的数量为N+1条,所述数据线的数量为M条;第i行所述像素单元中,所述像素单元的第二薄膜晶体管的栅极与第i条所述栅线连接,所述像素单元的第一薄膜晶体管的栅极与第i+1条所述栅线连接,其中,1≤i≤N。

优选地,第j列所述像素单元中,所述像素单元的第一薄膜晶体管的源极与第j条所述数据线连接,所述像素单元的第一薄膜晶体管的漏极与所述像素电极连接;所述像素单元的第二薄膜晶体管的源极与第j条所述数据线连接,所述像素单元的第二薄膜晶体管的漏极与所述公共电极连接;1≤j≤M。

在本发明提供的像素结构中,像素单元的第一薄膜晶体管与该像素单元的像素电极连接,像素单元的第二薄膜晶体管与该像素单元的公共电极连接,因此,使第一薄膜晶体管导通,则可以对像素电极充电,使第二薄膜晶体管导通,则可以对公共电极充电,在实现显示装置的显示时,可以使第一薄膜晶体管和第二薄膜晶体管导通,以分别对像素电极和公共电极进行充电,即可以单独对像素单元的像素电极的电压和公共电极的电压进行控制,使得像素单元的像素电极与公共电极之间的电压差匹配于待显示的画面,从而改善显示装置的画面显示质量,例如,防止闪烁、闪绿、残像等不良的出现。

本发明的目的还在于提供一种显示装置,用于改善显示装置的画面显示质量。

为了实现上述目的,本发明提供如下技术方案:

一种显示装置,所述显示装置包括上述技术方案所述的像素结构。

所述显示装置与上述像素结构相对于现有技术所具有的优势相同,在此不再赘述。

本发明的目的还在于提供一种像素结构的驱动方法,用于改善显示装置的画面显示质量。

为了实现上述目的,本发明提供如下技术方案:

一种像素结构的驱动方法,包括:

根据待显示的画面,确定各像素单元的像素电极与公共电极之间的电压差;

根据各所述像素单元的像素电极与公共电极之间的电压差,使所述像素单元的第一薄膜晶体管和第二薄膜晶体管导通,分别向对应的所述像素电极和所述公共电极充电。

优选地,使所述像素单元的第一薄膜晶体管和第二薄膜晶体管导通,分别向对应的所述像素电极和所述公共电极充电,包括:

通过第1条栅线,使第1行所述像素单元中各所述像素单元的第一薄膜晶体管导通,并通过各数据线,向第1行所述像素单元中各所述像素单元的像素电极充电;

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