[发明专利]选择电路

说明书

本发明适用于模拟电路技术领域，提供了一种选择电路，包括复位信号单元、时钟脉冲单元、多个依次连接时序控制单元和多个逻辑输出单元；所述时钟脉冲单元的输出端与各个依次连接的时序控制单元中的第一个时序控制单元的时钟脉冲输入端连接，所述复位信号单元的输出端分别与各个时序控制单元的复位信号输入端连接，每一个逻辑输出单元的输入端分别连接每个时序控制单元的输出端中的一个输出端，每一个时序控制单元的输出端包括正信号输出端和反信号输出端。本发明提供的选择电路实现多项选择输出时，控制线路少，结构简单，控制方便。

技术领域

本发明属于模拟电路技术领域，尤其涉及一种选择电路。

背景技术

随着电子行业的快速发展，各式各样的电子产品出现在人们的生活当中，这些电子产品大多需要具备选择输出的功能，而相关技术人员通常采用数据选择器或其他选择电路来实现这一功能，但是数据选择器和常规选择电路进行十六选一至少需要四个输入端，进行三十二选一则至少需要五个输入端，在面对大量线路的选择输出时，需要较多的输入线路进行控制，结构复杂。

发明内容

有鉴于此，本发明实施例提供了一种选择电路，以解决现有技术中选择电路控制线路多、结构复杂的问题。

本发明实施例提供了一种选择电路，包括：复位信号单元、时钟脉冲单元、多个依次连接的时序控制单元和多个逻辑输出单元；

所述时钟脉冲单元的输出端与各个依次连接的时序控制单元中的第一个时序控制单元的时钟脉冲输入端连接，所述复位信号单元的输出端分别与各个时序控制单元的复位信号输入端连接，每一个逻辑输出单元的输入端分别连接每个时序控制单元的输出端中的一个输出端，每一个时序控制单元的输出端包括正信号输出端和反信号输出端；

当所述复位信号单元的输入端输入高电平时，所述复位信号单元的输出端输出低电平，各个时序控制单元的正信号输出端输出低电平，各个时序控制单元的反信号输出端输出高电平，各个逻辑输出单元中的第一逻辑输出单元输出有效电平信号；当所述复位信号单元的输入端输入低电平时，所述复位信号单元的输出端输出高电平，所述时钟脉冲单元输出时钟脉冲信号到第一个时序控制单元，第一个时序控制单元根据所述时钟脉冲信号的周期个数通过正信号输出端输出一个正信号，通过反信号输出端输出一个反信号，且将正信号输出至与第一个时序控制单元连接的下一级时序控制单元和第二逻辑输出单元，将反信号输出至第三逻辑输出单元，各个时序控制单元中除第一个时序控制单元外剩余的每一级时序控制单元根据与其连接的上一级时序控制单元输出的正信号通过正信号输出端输出一个正信号，通过反信号输出端输出一个反信号，且将正信号输出至与其连接的下一级的时序控制单元和第四逻辑输出单元，将反信号输出至第五逻辑输出单元，各个逻辑输出单元中除所述第一逻辑输出单元外剩余的逻辑输出单元中的一个逻辑输出单元输出有效电平信号。

进一步地，时序控制单元包括第一PMOS管、第二PMOS管、第三PMOS管、第四PMOS管、第五PMOS管、第一NMOS管、第二NMOS管、第三NMOS管、第四NMOS管、第一反相器、第二反相器、第三反相器、第四反相器、第五反相器和第六反相器；