[发明专利]用于DPU运算的软件栈和编程有效
| 申请号： | 201710684841.2 | 申请日： | 2017-08-11 |
| 公开（公告）号： | CN108010551B | 公开（公告）日： | 2023-05-02 |
| 发明（设计）人： | 李双辰;牛迪民;克里希纳·马拉丁;郑宏忠 | 申请（专利权）人： | 三星电子株式会社 |
| 主分类号： | G11C11/408 | 分类号： | G11C11/408;G11C11/4097 |
| 代理公司： | 北京铭硕知识产权代理有限公司 11286 | 代理人： | 于翔;曾世骁 |
| 地址： | 韩国京畿*** | 国省代码： | 暂无信息 |
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| 摘要： | |||
| 搜索关键词： | 用于 dpu 运算 软件 编程 | ||
1.一种用于动态随机存取存储器DRAM处理单元DPU运算的系统，包括：
接口，用于接收命令；
库，用于确定与所接收到的命令相应的至少一个DPU运算；
编译器，用于形成与接收到的命令相应的用于所确定的至少一个DPU运算的至少一个DPU指令；以及
驱动器，用于将所述至少一个DPU指令发送到至少一个DPU，所述DPU包括包含按照具有至少一个列的阵列被布置的多个基于DRAM的计算单元的至少一个计算单元阵列，所述至少一个列包括至少三个行的基于DRAM的计算单元，所述至少三个行的基于DRAM的计算单元被配置为提供针对所述至少三个行中的第一行和第二行进行运算的逻辑功能，并被配置为将所述逻辑功能的结果存储在所述至少三个行中的第三行中。
2.如权利要求1所述的系统，其中，所述至少一个列的基于DRAM的计算单元均包括三晶体管一电容器(3T1C)DRAM存储器单元或一晶体管一电容器(1T1C)DRAM存储器单元，以及
其中，所述至少一个列的基于DRAM的计算单元提供或非逻辑功能。
3.如权利要求2所述的系统，其中，所述DPU还包括按照具有至少一个列的阵列被布置的多个基于DRAM的随机计算单元，所述至少一个列包括至少三个行的基于DRAM的随机计算单元，所述至少三个行的基于DRAM的随机计算单元被配置为提供针对所述至少三个行中的第一行和第二行进行运算的随机逻辑功能，并被配置为将所述随机逻辑功能的结果存储在所述至少三个行中的第三行中。
4.如权利要求3所述的系统，其中，所述至少一个列的基于DRAM的随机计算单元均包括三晶体管一电容器(3T1C)DRAM存储器单元或一晶体管一电容器(1T1C)DRAM存储器单元。
5.如权利要求4所述的系统，其中，所述至少一个DPU运算包括随机计算运算。
6.如权利要求1所述的系统，其中，所述DPU还包括按照具有至少一个列的阵列被布置的多个基于DRAM的随机计算单元，所述至少一个列包括至少三个行的基于DRAM的随机计算单元，所述至少三个行的基于DRAM的随机计算单元被配置为提供针对所述至少三个行中的第一行和第二行进行运算的随机逻辑功能，并被配置为将所述随机逻辑功能的结果存储在所述至少三个行中的第三行中。
7.如权利要求1所述的系统，其中，所述库还用于响应于所接收到的命令来确定整个卷积层的映射。
8.如权利要求1所述的系统，其中，所述库还用于确定所述至少一个DPU运算内的多个并行性，所述至少一个DPU运算将多个DPU进行映射以执行与所接收到的命令相应的所述至少一个DPU运算。
9.如权利要求1所述的系统，其中，所述驱动器还用于基于所接收到的命令控制进出DPU的数据移动。
10.如权利要求1所述的系统，其中，所述编译器还用于形成与所接收到的命令相应的单个DPU指令，所述单个DPU指令针对所述至少一个DPU中的至少一行进行运算。
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