[发明专利]一种处理器有效

专利信息
申请号: 201710449025.3 申请日: 2017-06-14
公开(公告)号: CN107358125B 公开(公告)日: 2020-12-08
发明(设计)人: 刘大力;曹春春 申请(专利权)人: 北京多思科技工业园股份有限公司
主分类号: G06F21/71 分类号: G06F21/71;G06F9/30
代理公司: 北京市隆安律师事务所 11323 代理人: 权鲜枝;何立春
地址: 100195 北京市*** 国省代码: 北京;11
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摘要:
搜索关键词: 一种 处理器
【说明书】:

发明公开了一种处理器,包括:指令队列存储区、配置信息存储区、译码控制单元、显式译码器和隐式译码器;所述指令队列存储区用于存储待译码的指令队列;所述配置信息存储区用于存储配置信息,所述配置信息中包括译码约束信息;所述译码控制单元用于根据所述配置信息存储区中的译码约束信息将所述指令队列中的指令分配给所述显式译码器或所述隐式译码器进行译码。本发明实施例提供的这种处理器通过增加处理器中译码工作的维度,不仅能够提升译码效率,更重要是还能够提升处理器中指令译码过程的复杂度,使得处理器在运行时其指令译码过程不容易被恶意破解,极大地提高了处理器中的译码安全性,保证处理器安全、稳固地运行。

技术领域

本发明涉及处理器技术领域,特别涉及一种具有高安全级别的处理器。

背景技术

由于信息技术的快速发展,信息安全的重要性与日俱增。要保证信息的 安全,必须确保处理器的安全性。安全处理器是信息安全领域的关键技术。

目前的“安全处理器”,主要通过运行加密算法软件来实现处理器的安全 处理。但是这种加密算法被破解的几率较大,且加密算法的实现大大降低了 处理器的整体性能,随着实际当中对数据处理速率的要求越来越高,简单的 用加密算法软件来保证处理的安全已不再适用。

发明内容

有鉴于此,本发明提供了一种处理器,以至少部分地解决上述问题。

本发明提供了一种处理器,包括:指令队列存储区、配置信息存储区、 译码控制单元、显式译码器和隐式译码器;

指令队列存储区用于存储待译码的指令队列;

配置信息存储区用于存储配置信息,配置信息中包括译码约束信息;

译码控制单元用于根据配置信息存储区中的译码约束信息将指令队列中 的指令分配给显式译码器或隐式译码器进行译码。

可选地,处理器还包括:备份译码器;

译码控制单元还用于根据配置信息存储区中的译码约束信息将指令队列 中既未分配给显式译码器也未分配给隐式译码器的指令分配给备份译码器进 行译码。

可选地,处理器还包括:显式指令寄存器、隐式指令寄存器和备份指令 寄存器;

译码控制单元用于根据配置信息存储区中的译码约束信息将指令队列中 的指令分配至显式指令寄存器、隐式指令寄存器或备份指令寄存器;

显式译码器用于对显式指令寄存器中的指令进行译码;

隐式译码器用于对隐式指令寄存器中的指令进行译码;

所述备份译码器用于对备份指令寄存器中的指令进行译码。

可选地,译码控制单元还用于根据配置信息存储区中的译码约束信息控 制显式译码器、隐式译码器和备份译码器中每二者之间以并行或串行的时序 进行译码。

可选地,译码控制单元还用于根据配置信息存储区中的译码约束信息, 对显式指令寄存器中的多条指令进行宏加工得到宏指令,对隐式指令寄存器 中的多条指令进行宏加工得到宏指令,和/或,对备份隐式指令寄存器中的多 条指令进行宏加工得到宏指令;

显式译码器用于对显式指令寄存器中的宏指令进行译码;

隐式译码器用于对隐式指令寄存器中的宏指令进行译码;

备份译码器用于对备份指令寄存器中的宏指令进行译码。

可选地,对显式指令寄存器中的多条指令进行的宏加工包括:对显示指 令寄存器中的多条指令进行的排序、拼装、替换和/或延时;

对隐式指令寄存器中的多条指令进行的宏加工包括:对隐式指令寄存器 中的多条指令进行的排序、拼装、替换和/或延时;

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