[发明专利]纳米级沟道的制备方法在审
申请号: | 201710239765.4 | 申请日: | 2017-04-13 |
公开(公告)号: | CN108735581A | 公开(公告)日: | 2018-11-02 |
发明(设计)人: | 陈墨;李群庆;张立辉;肖小阳;张金;范守善 | 申请(专利权)人: | 清华大学;鸿富锦精密工业(深圳)有限公司 |
主分类号: | H01L21/027 | 分类号: | H01L21/027;H01L21/033;H01L29/786;H01L21/336;B82Y40/00;B82Y10/00 |
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地址: | 100084 北京市海淀区清*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 光刻胶层 纳米线 纳米级沟道 纳米线结构 基底表面 悬空 暴露 凹槽处 基底 制备 层叠设置 沉积薄膜 薄膜层 掩模 沉积 投影 | ||
1.一种纳米级沟道的制备方法,其包括以下步骤:
提供一基底,在所述基底的表面层叠设置一第一光刻胶层、一纳米线结构、一第二光刻胶层,且所述纳米线结构夹于该第一光刻胶层和第二光刻胶层之间,所述纳米线结构包括至少一纳米线;
在所述第一光刻胶层和第二光刻胶层上设置至少一凹槽,并使得该凹槽处对应的基底表面暴露,所述纳米线部分暴露并悬空于所述凹槽处,该悬空的纳米线的两端均夹于所述第一光刻胶层和第二光刻胶层之间;
以悬空的纳米线作掩模,向暴露的基底表面沉积一薄膜层,所述悬空的纳米线投影于暴露的基底表面上未沉积薄膜层的区域,即为纳米级沟道。
2.如权利要求1所述的纳米级沟道的制备方法,其特征在于,在所述基底的表面层叠设置一第一光刻胶层、一纳米线结构、一第二光刻胶层的方法包括以下步骤:在所述基底的表面设置所述第一光刻胶层;再将所述纳米线结构及第二光刻胶层一起转移至该第一光刻胶层的表面。
3.如权利要求1所述的纳米级沟道的制备方法,其特征在于,在所述基底的表面层叠设置一第一光刻胶层、一纳米线结构、一第二光刻胶层的方法包括以下步骤:将所述第一光刻胶层及纳米线结构一起转移至所述基底的表面;再将该第二光刻胶层设置于该纳米线结构的表面。
4.如权利要求1所述的纳米级沟道的制备方法,其特征在于,在所述基底的表面层叠设置一第一光刻胶层、一纳米线结构、一第二光刻胶层的方法包括以下步骤:将所述第一光刻胶层及一第一纳米线结构单元一起转移至所述基底的表面;再将所述第二光刻胶层及一第二碳纳米管结构单元一起转移至所述第一纳米线结构单元的表面上,且所述第一纳米线结构单元与所述第二纳米线结构单元接触并形成所述纳米线结构。
5.如权利要求1所述的纳米级沟道的制备方法,其特征在于,所述纳米线结构包括多根纳米线,所述多根纳米线沿同一方向延伸或交叉排列。
6.如权利要求1所述的纳米级沟道的制备方法,其特征在于,所述凹槽是通过图案化曝光所述第一光刻胶层和第二光刻胶层得到。
7.如权利要求1所述的纳米级沟道的制备方法,其特征在于,所述第一光刻胶层的厚度为50纳米-400纳米。
8.如权利要求1所述的纳米级沟道的制备方法,其特征在于,所述薄膜层的厚度小于所述第一光刻胶层的厚度。
9.如权利要求1所述的纳米级沟道的制备方法,其特征在于,进一步包括在制备得到纳米级沟道后去除第一光刻胶层、第二光刻胶层及纳米线结构的步骤。
10.如权利要求9所述的纳米级沟道的制备方法,其特征在于,去除所述第一光刻胶层、第二光刻胶层及纳米线结构的方法为将所述第一光刻胶层、第二光刻胶层及纳米线结构置于去胶溶液中去除。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造