[发明专利]半导体装置有效
申请号: | 201710147817.5 | 申请日: | 2011-12-29 |
公开(公告)号: | CN106936421B | 公开(公告)日: | 2020-09-01 |
发明(设计)人: | 饭岛正章;出口光宏 | 申请(专利权)人: | 瑞萨电子株式会社 |
主分类号: | H03K19/00 | 分类号: | H03K19/00;H03K19/096 |
代理公司: | 中国国际贸易促进委员会专利商标事务所 11038 | 代理人: | 欧阳帆 |
地址: | 日本*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 半导体 装置 | ||
1.一种半导体装置,具备:
时钟生成器,所述时钟生成器配置为生成具有所设定的频率的时钟信号;以及
接口电路,所述接口电路被配置为根据所述时钟信号,向外部存储器装置供给动作时钟,
所述接口电路具备:
缓冲器,配置为从所述外部存储器装置接收数据信号和选通信号;
延迟电路,配置为延迟所接收的选通信号;以及
数据检测电路,配置为在利用所述延迟电路延迟后的所述选通信号的边缘的定时,对所述数据信号进行采样,
所述延迟电路具备:
第1调整电路,包括多个延迟元件,并且配置为在多个阶段调整所述选通信号的延迟量,以及
第2调整电路,与所述第1调整电路串联地连接,并且能够以比所述第1调整电路更细的精度调整所述选通信号的延迟量,以及
所述第1调整电路进一步具备:
旁通线,与所述多个延迟元件的一部分并联地连接,并且具有比与所述旁通线并联连接的延迟元件的所述一部分的整体的延迟量小的延迟量,以及
选择器,配置为在非测试模式中选择以及输出通过了所述多个延迟元件的所述一部分的选通信号或者在测试模式中选择以及输出通过了与所述多个延迟元件的所述一部分并联连接的所述旁通线的选通信号,其中
在所述第1调整电路中设置的所述多个延迟元件彼此串联连接,并被划分为分别包括多个延迟元件的第1个块至第M个块这M个块,
所述第1调整电路包括:
M个旁通线,作为与相应的M个块对应的旁通线;以及
M个选择器,作为与相应的M个块对应的选择器,
所述M个旁通线中的每个旁通线与所述M个块中的对应的一个块并联连接,
所述M个选择器中的每个选择器配置为在非测试模式中选择通过所述M个块中的对应的一个块的选通信号,或在测试模式中选择通过与所述M个块中的对应的一个块并联连接的旁通线的选通信号,以及
所述第1调整电路进一步具备选择电路,所述选择电路配置为根据所述时钟信号的所设定的频率选择与相应的M个块对应的M个选择器的输出中的一个。
2.根据权利要求1所述的半导体装置,进一步具备:
中央处理单元,配置为设定所述时钟信号的频率;以及
控制电路,配置为输出与时钟信号的所设定的频率对应的延迟量设定值,其中
所述选择电路被配置为根据所述延迟量设定值选择与相应的M个块对应的选择器的输出中的一个。
3.根据权利要求2所述的半导体装置,其中:
所述控制电路被配置为确定所述延迟量设定值,使得所述所设定的频率越小,所述选通信号所通过的延迟元件数越大。
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