[发明专利]提高FPGA原型验证效率的装置及方法有效
| 申请号： | 201710103775.5 | 申请日： | 2017-02-24 |
| 公开（公告）号： | CN106919748B | 公开（公告）日： | 2021-01-22 |
| 发明（设计）人： | 王棚辉;乔英良 | 申请（专利权）人： | 苏州浪潮智能科技有限公司 |
| 主分类号： | G06F30/347 | 分类号： | G06F30/347 |
| 代理公司： | 郑州大通专利商标代理有限公司 41111 | 代理人： | 陈勇 |
| 地址： | 215000 江苏省苏州*** | 国省代码： | 江苏;32 |
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| 摘要： | |||
| 搜索关键词： | 提高 fpga 原型 验证 效率 装置 方法 | ||
1.一种提高FPGA原型验证效率的装置，其特征在于，该装置包括：监控单元，所述监控单元进一步包括：被监控报文存储单元，传输报文接收单元，触发判断单元及异常结果发送单元，其中：
所述被监控报文存储单元，用于存储被监控报文的内容；
所述传输报文接收单元，用于接收并读取来自NC芯片的传输报文；
所述触发判断单元，用于对比传输报文的内容与被监控报文的内容是否一致，若一致，则该NC芯片异常，触发判断单元进入暂停状态，并将异常芯片的信息发送给异常结果发送单元，所述异常结果发送单元将异常结果发送给外部分析设备；若不一致，则该NC芯片正常，返回传输报文接收单元继续接收并读取来自NC芯片的传输报文；
还包括，结果分析单元，用于通过外部分析设备对异常NC芯片进行分析。
2.根据权利要求1所述的提高FPGA原型验证效率的装置，其特征在于，所述传输报文接收单元位于被监控报文存储单元和触发判断单元之间。
3.根据权利要求1所述的提高FPGA原型验证效率的装置，其特征在于，所述触发判断单元位于传输报文接收单元和异常结果发送单元之间。
4.基于权利要求1~3中任一项所述的提高FPGA原型验证效率的装置的提高FPGA原型验证效率的方法，其特征在于，包括以下步骤：
步骤1：在FPGA原型验证平台中添加监控单元，所述监控单元包括：被监控报文存储单元、传输报文接收单元、触发判断单元及异常结果发送单元；
步骤2：将被监控报文的内容存储至被监控报文存储单元；
步骤3：传输报文接收单元接收并读取来自NC芯片的传输报文；
步骤4：触发判断单元对比传输报文的内容与被监控报文的内容是否一致，若一致，则该NC芯片异常，触发判断单元进入暂停状态，并将异常芯片的信息发送给异常结果发送单元，所述异常结果发送单元将异常结果发送给外部分析设备；若不一致，则该NC芯片正常，返回步骤3继续接收并读取来自NC芯片的传输报文；
步骤5：通过外部分析设备对异常NC芯片进行分析。
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