[实用新型]基于二乘二取二架构的移频电码化信号驱动系统有效

专利信息
申请号: 201621169726.9 申请日: 2016-10-26
公开(公告)号: CN206367481U 公开(公告)日: 2017-08-01
发明(设计)人: 叶瑞源;房增华;陈亮;李卫娟;季志均;包莉;明宏全;林伟欣;李海海;李新新 申请(专利权)人: 卡斯柯信号有限公司
主分类号: B61L1/18 分类号: B61L1/18
代理公司: 上海科盛知识产权代理有限公司31225 代理人: 应小波
地址: 200070 上海市闸北区*** 国省代码: 上海;31
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摘要:
搜索关键词: 基于 二乘二取二 架构 电码 信号 驱动 系统
【说明书】:

技术领域

实用新型涉及一种铁路信号设备系统,尤其是涉及一种基于二乘二取二架构的移频电码化信号驱动系统。

背景技术

随着我国铁路事业的发展,对站内轨道电路的要求也越来越高了,安全设备容不得半点闪失,而轨道电路分路不良却时时威胁着行车安全。为实现对移频电码化信号的正确驱动并将移频电码化信号正确发送到轨道区段上,需要搭建较为复杂的继电电路和监测电路来实现,这使得实际设计和施工中需要较多继电器及监测电路。这些继电器和监测电路成本较高,且会在机房占用较大空间。另外,某个继电器发生故障时,无法及时报警,不方便现场维护。

实用新型内容

本实用新型的目的就是为了克服上述现有技术存在的缺陷而提供一种基于二乘二取二架构的移频电码化信号驱动系统。

本实用新型的目的可以通过以下技术方案来实现:

一种基于二乘二取二架构的移频电码化信号驱动系统,包括联锁下位机IPS、联锁维护台SDM、移频电码化驱动模块CDDM、发码器和全电子通信模块EIOCOM2,所述的发码器、移频电码化驱动模块CDDM、全电子通信模块EIOCOM2、联锁下位机IPS依次连接,所述的全电子通信模块EIOCOM2与联锁维护台SDM连接。

所述的联锁下位机IPS、全电子通信模块EIOCOM2和移频电码化驱动模块CDDM均为二乘二取二的安全冗余系统。

所述的移频电码化驱动模块CDDM设有10路编码信号和6路发码信号的输出接口,并带有对自身模块上的安全器件进行周期性检测模块。

所述的移频电码化驱动模块CDDM包括处理器、编码继电器、发码继电器和继电器驱动电源,所述的处理器包括FPGA和CPU,所述的FPGA分别与CPU、编码继电器、发码继电器、继电器驱动电源连接;所述的CPU通过全电子通信模块EIOCOM2与联锁维护台SDM连接。

所述的FPGA和CPU均采用双机热备冗余。

所述的移频电码化驱动模块CDDM还包括与FPGA连接的FBJ采集模块。

所述的移频电码化驱动模块CDDM还包括分别与处理器、编码继电器、发码继电器和继电器驱动电源连接的隔离模块。

所述的移频电码化驱动模块CDDM还包括分别与处理器和隔离模块连接的熔丝模块。

与现有技术相比,本实用新型具有以下优点:

1)该系统基于二取二架构和BIT技术,保证了安全性;利用高性能CPU和FPGA及小型继电器,取代以往继电电路方式,降低了施工难度和项目成本;而二乘二的冗余设计并支持热插拔,可以大大提高系统可靠性和可维护性。

2)系统能够以更低成本,更简单的施工,以及更方便的维护,来取代以往的继电电路和监测电路;CDDM能够根据IPS发送的命令,驱动编码信号和发码信号。

附图说明

图1为本实用新型移频电码化信号驱动系统结构示意图;

图2为本实用新型移频电码化驱动模块CDDM内部原理图。

具体实施方式

下面结合附图和具体实施例对本实用新型进行详细说明。本实施例以本实用新型技术方案为前提进行实施,给出了详细的实施方式和具体的操作过程,但本实用新型的保护范围不限于下述的实施例。

如图1所示,一种基于二乘二取二架构的移频电码化信号驱动系统,包括联锁下位机IPS、联锁维护台SDM、移频电码化驱动模块CDDM、发码器FM和全电子通信模块EIOCOM2,所述的发码器FM、移频电码化驱动模块CDDM、全电子通信模块EIOCOM2、联锁下位机IPS依次连接,所述的全电子通信模块EIOCOM2与联锁维护台SDM连接;所述的移频电码化驱动模块CDDM通过联锁下位机IPS获取编码和发码命令,并向发码器发送编码信号,驱动发码器产生相应的移频信号,同时根据发码命令选择发送移频信号的轨道区段。

所述的移频电码化驱动模块CDDM设有10路编码信号和6路发码信号的输出接口,并带有对自身模块上的安全器件进行周期性检测模块。

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