[实用新型]基于二乘二取二架构的移频电码化信号驱动系统有效
| 申请号： | 201621169726.9 | 申请日： | 2016-10-26 |
| 公开（公告）号： | CN206367481U | 公开（公告）日： | 2017-08-01 |
| 发明（设计）人： | 叶瑞源;房增华;陈亮;李卫娟;季志均;包莉;明宏全;林伟欣;李海海;李新新 | 申请（专利权）人： | 卡斯柯信号有限公司 |
| 主分类号： | B61L1/18 | 分类号： | B61L1/18 |
| 代理公司： | 上海科盛知识产权代理有限公司31225 | 代理人： | 应小波 |
| 地址： | 200070 上海市闸北区*** | 国省代码： | 上海;31 |
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| 摘要： | |||
| 搜索关键词： | 基于 二乘二取二 架构 电码 信号 驱动 系统 | ||
1.一种基于二乘二取二架构的移频电码化信号驱动系统，其特征在于，包括联锁下位机IPS、联锁维护台SDM、移频电码化驱动模块CDDM、发码器和全电子通信模块EIOCOM2，所述的发码器、移频电码化驱动模块CDDM、全电子通信模块EIOCOM2、联锁下位机IPS依次连接，所述的全电子通信模块EIOCOM2与联锁维护台SDM连接。
2.根据权利要求1所述的一种基于二乘二取二架构的移频电码化信号驱动系统，其特征在于，所述的联锁下位机IPS、全电子通信模块EIOCOM2和移频电码化驱动模块CDDM均为二乘二取二的安全冗余系统。
3.根据权利要求1所述的一种基于二乘二取二架构的移频电码化信号驱动系统，其特征在于，所述的移频电码化驱动模块CDDM设有10路编码信号和6路发码信号的输出接口，并带有对自身模块上的安全器件进行周期性检测模块。
4.根据权利要求1或3所述的一种基于二乘二取二架构的移频电码化信号驱动系统，其特征在于，所述的移频电码化驱动模块CDDM包括处理器、编码继电器、发码继电器和继电器驱动电源，所述的处理器包括FPGA和CPU，所述的FPGA分别与CPU、编码继电器、发码继电器、继电器驱动电源连接；所述的CPU通过全电子通信模块EIOCOM2与联锁维护台SDM连接。
5.根据权利要求4所述的一种基于二乘二取二架构的移频电码化信号驱动系统，其特征在于，所述的FPGA和CPU均采用双机热备冗余。
6.根据权利要求4所述的一种基于二乘二取二架构的移频电码化信号驱动系统，其特征在于，所述的移频电码化驱动模块CDDM还包括与FPGA连接的FBJ采集模块。
7.根据权利要求4所述的一种基于二乘二取二架构的移频电码化信号驱动系统，其特征在于，所述的移频电码化驱动模块CDDM还包括分别与处理器、编码继电器、发码继电器和继电器驱动电源连接的隔离模块。
8.根据权利要求7所述的一种基于二乘二取二架构的移频电码化信号驱动系统，其特征在于，所述的移频电码化驱动模块CDDM还包括分别与处理器和隔离模块连接的熔丝模块。
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