[发明专利]半导体存储装置以及其制作方法有效
申请号: | 201611258003.0 | 申请日: | 2016-12-30 |
公开(公告)号: | CN108269805B | 公开(公告)日: | 2021-06-08 |
发明(设计)人: | 张峰溢;邹世芳;李甫哲;蔡建成;黄丰铭 | 申请(专利权)人: | 联华电子股份有限公司;福建省晋华集成电路有限公司 |
主分类号: | H01L27/108 | 分类号: | H01L27/108;H01L21/8242 |
代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 陈小雯 |
地址: | 中国台*** | 国省代码: | 台湾;71 |
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摘要: | |||
搜索关键词: | 半导体 存储 装置 及其 制作方法 | ||
1.一种半导体存储装置,包括:
半导体基底,包括多个主动区;
浅沟槽隔离,设置于该半导体基底中,其中该浅沟槽隔离设置于该多个主动区之间;
位线接触开口,设置于该多个主动区中的其中一个以及该浅沟槽隔离中,其中该位线接触开口的边缘具有一底切结构;以及
位线结构,部分设置于该位线接触开口中且与该位线接触开口对应的该主动区接触,
其中该位线接触开口的底部宽度大于该位线接触开口的顶部宽度。
2.如权利要求1所述的半导体存储装置,还包括一隔离结构,设置于该位线接触开口的该底切结构中,其中该隔离结构为一上窄下宽的结构。
3.如权利要求2所述的半导体存储装置,还包括一间隙子层,该间隙子层的一部分设置于该位线结构上,该间隙子层的另一部分设置于该位线接触开口中且位于该隔离结构与该位线结构之间。
4.如权利要求2所述的半导体存储装置,其中该隔离结构的底面低于该位线接触开口对应的该主动区的顶面。
5.如权利要求2所述的半导体存储装置,其中该隔离结构的侧面包括一弧形面。
6.一种半导体存储装置的制作方法,包括:
提供一半导体基底,其中一浅沟槽隔离形成于该半导体基底中而定义出多个主动区;
进行一第一蚀刻制作工艺,用以于该半导体基底中形成一位线接触开口,其中该位线接触开口对应且暴露出该多个主动区中的其中一个,且该位线接触开口的边缘具有一底切结构;以及
在该半导体基底上形成一位线结构,其中该位线结构的一部分设置于该位线接触开口中且与该位线接触开口对应的该主动区接触,
其中该位线接触开口的底部宽度大于该位线接触开口的顶部宽度。
7.如权利要求6所述的半导体存储装置的制作方法,还包括:
在该位线接触开口的该底切结构中形成一隔离结构,其中该隔离结构为一上窄下宽的结构。
8.如权利要求7所述的半导体存储装置的制作方法,其中该隔离结构的制作方法包括:
在该半导体基底上以及该位线接触开口中形成一绝缘层,其中该绝缘层填入该位线接触开口的该底切结构中;以及
对该绝缘层进行一第二蚀刻制作工艺,用以移除位于该位线接触开口之外的该绝缘层以及位于该位线接触开口中的部分的该绝缘层而于该底切结构中形成该隔离结构。
9.如权利要求8所述的半导体存储装置的制作方法,其中该第二蚀刻制作工艺于该位线结构形成之前进行。
10.如权利要求7所述的半导体存储装置的制作方法,还包括:
在该半导体基底以及该位线结构上形成一间隙子层,其中该间隙子层的一部分形成于该位线接触开口中且位于该隔离结构与该位线结构之间。
11.如权利要求7所述的半导体存储装置的制作方法,其中该隔离结构的底面低于该位线接触开口对应的该主动区的顶面。
12.如权利要求7所述的半导体存储装置的制作方法,其中该隔离结构的侧面包括一弧形面。
13.如权利要求6所述的半导体存储装置的制作方法,其中该位线接触开口的该底切结构的底面低于该位线接触开口对应的该主动区的顶面。
14.如权利要求6所述的半导体存储装置的制作方法,其中该位线接触开口的该底切结构形成于该浅沟槽隔离中。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
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H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
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H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的