[发明专利]一种半导体器件及其制作方法、电子装置有效
申请号: | 201610719827.7 | 申请日: | 2016-08-24 |
公开(公告)号: | CN107785374B | 公开(公告)日: | 2020-11-10 |
发明(设计)人: | 陈卓凡;张翼英 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司 |
主分类号: | H01L27/11517 | 分类号: | H01L27/11517 |
代理公司: | 北京市磐华律师事务所 11336 | 代理人: | 高伟;张建 |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 一种 半导体器件 及其 制作方法 电子 装置 | ||
1.一种半导体器件的制作方法,其特征在于,包括下述步骤:
提供半导体衬底,所述半导体衬底上形成有含硅凸起阵列和用于形成隔离结构的沟槽;
形成填充所述含硅凸起阵列间隙和用于形成隔离结构的沟槽的隔离结构氧化物;
去除部分所述填充层以露出所述含硅凸起的顶端;
对所述含硅凸起的顶端执行离子体处理以在所述含硅凸起的顶端形成电流阻挡层;
去除部分所述填充层以露出所述含硅凸起,并在所述半导体衬底中形成隔离结构。
2.根据权利要求1所述的半导体器件的制作方法,其特征在于,在所述半导体衬底上形成含硅凸起阵列的步骤包括:
在所述半导体衬底上形成含硅材料层和图形化的硬掩膜层;
以所述图形化的硬掩膜层为掩膜刻蚀所述含硅材料层以形成含硅凸起阵列;
以所述图形化的硬掩膜层为掩膜刻蚀所述半导体衬底以形成用于形成隔离结构的沟槽。
3.根据权利要求2所述的半导体器件的制作方法,其特征在于,所述图形化硬掩膜层包括氧化物。
4.根据权利要求3所述的半导体器件的制作方法,其特征在于,在所述含硅材料层和所述图形化硬掩膜层之间还形成有氮化物停止层。
5.根据权利要求1所述的半导体器件的制作方法,其特征在于,所述电流阻挡层为氮化物。
6.根据权利要求5所述的半导体器件的制作方法,对所述含硅凸起的顶端执行含氮等离子体处理,以形成所述氮化物。
7.根据权利要求6所述的半导体器件的制作方法,其特征在于,所述含氮等离子体处理为N2或NH3等离子体处理。
8.根据权利要求1所述的半导体器件的制作方法,其特征在于,所述含硅凸起阵列为多晶硅浮栅阵列。
9.根据权利要求1所述的半导体器件的制作方法,其特征在于,所述含硅凸起阵列为含硅鳍片阵列。
该专利技术资料仅供研究查看技术是否侵权等信息,商用须获得专利权人授权。该专利全部权利属于中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司,未经中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司许可,擅自商用是侵权行为。如果您想购买此专利、获得商业授权和技术合作,请联系【客服】
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的