[发明专利]电平转移电路及其驱动方法、栅极驱动电路和显示装置有效
申请号: | 201610616815.1 | 申请日: | 2016-07-29 |
公开(公告)号: | CN106023941B | 公开(公告)日: | 2018-05-01 |
发明(设计)人: | 刘宝玉;孙志华 | 申请(专利权)人: | 京东方科技集团股份有限公司;北京京东方显示技术有限公司 |
主分类号: | G09G3/36 | 分类号: | G09G3/36;H03K19/0185 |
代理公司: | 北京天昊联合知识产权代理有限公司11112 | 代理人: | 彭瑞欣,陈源 |
地址: | 100015 *** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 电平 转移 电路 及其 驱动 方法 栅极 显示装置 | ||
技术领域
本发明涉及显示技术领域,具体涉及一种电平转移电路及其驱动方法、栅极驱动电路和显示装置。
背景技术
薄膜晶体管液晶显示装置以其显示画质好、低电压、低功耗、响应速度快等特点收到了广泛好评。显示装置包括设置有薄膜晶体管阵列的阵列基板,进行显示时,通过移位寄存器向每行栅线依次提供扫描信号,使得每一行的薄膜晶体管依次开启。薄膜晶体管所需要的开启电压较高,而移位寄存器输出的电压较低,不能达到打开薄膜晶体管开关的要求。为此,通常利用电平转移电路将较低的电平转换为较高的电平信号。
电平转移电路中设置有储能元件,现有技术的电平转移电路通常采用电感作为储能元件,并配合使用二极管,这就导致电路的电子器件较多,占用面积较大,耗能较大,电平转换效率较低。
发明内容
本发明旨在至少解决现有技术中存在的技术问题之一,提出了一种电平转移电路及其驱动方法、栅极驱动电路和显示装置,以提高电平转换效率。
为了解决上述技术问题之一,本发明提供一种电平转移电路,包括:
信号输入端、第一高电平输入端、第二高电平输入端、低电平输入端、预输出端;
存储电容,所述存储电容的第一端与所述预输出端相连;
预充模块,所述预充模块的控制端与所述信号输入端相连,所述预充模块的第一输入端与所述第一高电平输入端相连,所述预充模块的第二输入端与所述低电平输入端相连,所述预充模块的第一输出端与所述存储电容的第一端相连,所述预充模块的第二输出端与所述存储电容的第二端相连;所述预充模块的第一输入端与第一输出端用于在所述信号输入端输入高电平的控制信号时导通、并在所述信号输入端输入低电平的控制信号时断开;所述预充模块的第二输入端与第二输出端用于在所述信号输入端输入所述高电平信号时导通、并在所述信号输入端输入所述低电平信号时断开;和
升压模块,所述升压模块的控制端与所述信号输入端相连,所述升压模块的输入端与所述第二高电平输入端相连,所述升压模块的输出端与所述存储电容的第二端相连,所述升压模块的输入端与输出端用于在所述信号输入端输入所述高电平的控制信号时断开、并在所述信号输入端输入所述低电平的控制信号时导通;
其中,所述第二高电平输入端与所述低电平输入端之间的电压差与所述第一高电平输入端的电压之和大于所述高电平的控制信号的电压。
优选地,所述电平转移电路还包括:
最终输出端;和
输出模块,所述输出模块的第一输入端与所述预输出端相连,所述输出模块的第二输入端与所述低电平输入端相连,所述输出模块的控制端与所述信号输入端相连,所述输出模块的输出端与所述最终输出端相连;所述输出模块的第一输入端与输出端用于在该输出模块的控制端接收到所述低电平的控制信号时导通,所述输出模块的第二输入端与输出端用于在该输出模块的控制端接收到所述高电平的控制信号导通。
优选地,所述预充模块包括第一预充单元和第二预充单元,
所述第一预充单元控制端和所述第二预充单元的控制端相连,并共同形成为所述预充模块的控制端,所述第一预充单元的输入端为所述预充模块的第一输入端,所述第一预充单元的输出端为所述预充模块的第一输出端;所述第一预充单元的输入端与输出端用于在该第一预充单元的控制端接收到所述高电平的控制信号时导通、并在该第一预充单元的控制端接收到所述低电平的控制信号时断开;
所述第二预充单元的输入端为所述预充模块的第二输入端,所述第二预充单元的输出端为所述预充模块的第二输出端;所述第二预充单元的输入端与输出端用于在该第二预充单元的控制端接收到所述高电平的控制信号时导通、并在该第二预充单元的控制端接收到所述低电平的控制信号时断开。
优选地,所述第一预充单元包括第一P型晶体管、第一N型晶体管和第二P型晶体管,
所述第一N型晶体管的栅极和所述第一P型晶体管的栅极相连,并共同形成所述第一预充单元的控制端,所述第一P型晶体管的第一极与所述存储电容的第一端相连,所述第一P型晶体管的第二极、所述第一N型晶体管的第二极和所述第二P型晶体管的栅极连接在一起,所述第一N型晶体管的第一极与所述低电平输入端相连,所述第二P型晶体管的第一极为所述第一预充单元的输入端,所述第二P型晶体管的第二极为所述第一预充单元的输出端。
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