[发明专利]CMOS器件、PMOS器件及NMOS器件的形成方法有效
申请号: | 201610414190.0 | 申请日: | 2016-06-13 |
公开(公告)号: | CN107492522B | 公开(公告)日: | 2020-04-07 |
发明(设计)人: | 李勇 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司 |
主分类号: | H01L21/8238 | 分类号: | H01L21/8238;H01L21/336;H01L21/28;H01L29/06;H01L29/423 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 高静;吴敏 |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | cmos 器件 pmos nmos 形成 方法 | ||
1.一种NMOS器件的形成方法,其特征在于,包括:
提供NMOS区域的基底,所述NMOS区域包括第一N型阈值电压区、第二N型阈值电压区以及第三N型阈值电压区;
对所述第一N型阈值电压区以及第三N型阈值电压区的基底进行第三阈值电压掺杂处理;
对所述第二N型阈值电压区的基底进行第四阈值电压掺杂处理,且所述第三阈值电压掺杂处理的掺杂浓度大于第四阈值电压掺杂处理的掺杂浓度;
在所述基底上形成栅介质层;
在所述第一N型阈值电压区的栅介质层上形成第一N型功函数层;
在所述第二N型阈值电压区以及第三N型阈值电压区的栅介质层上形成第二N型功函数层,且所述第二N型功函数层的厚度大于所述第一N型功函数层的厚度;
在所述第一N型功函数层上以及第二N型功函数层上形成金属层;
形成所述第一N型功函数层以及第二N型功函数层的工艺步骤包括:
在所述栅介质层上形成第一N型子功函数膜,所述第一N型子功函数膜位于第一N型阈值电压区、第二N型阈值电压区以及第三N型阈值电压区;
刻蚀去除位于所述第一N型阈值电压区的第一N型子功函数膜,在所述第二N型阈值电压区以及第三N型阈值电压区形成第一N型子功函数层;
接着,在所述第一N型阈值电压区的栅介质层上、以及所述第一N型子功函数层上形成第二N型子功函数层,其中,位于所述第一N型阈值电压区的第二N型子功函数层作为所述第一N型功函数层,所述第一N型子功函数层以及位于第一N型子功函数层上的第二N型子功函数层作为所述第二N型功函数层。
2.如权利要求1所述的NMOS器件的形成方法,其特征在于,所述第三阈值电压掺杂处理的掺杂离子为P型离子,掺杂浓度为5E13atom/cm3至1E16atom/cm3;所述第四阈值电压掺杂处理的掺杂离子为P型离子,掺杂浓度为1E12atom/cm3至1E14atom/cm3。
3.如权利要求1所述的NMOS器件的形成方法,其特征在于,在所述第一N型阈值电压区的栅介质层上形成第一阻挡层,在所述第二N型阈值电压区以及第三阈值电压区的栅介质层上形成第二阻挡层。
4.如权利要求3所述的NMOS器件的形成方法,其特征在于,所述第一N型子功函数层的厚度为30埃~100埃;所述第二N型子功函数层的厚度为20埃~50埃。
5.如权利要求1所述的NMOS器件的形成方法,其特征在于,在形成所述栅介质层之前,还包括步骤:在所述基底上形成层间介质层,所述层间介质层内形成有贯穿所述层间介质层的开口,所述开口包括,位于第一N型阈值电压区的第四开口、位于第二N型阈值电压区的第五开口、以及位于第三N性阈值电压区的第六开口,其中,所述栅介质层位于所述开口底部和侧壁上,且形成的所述金属层填充满开口。
6.如权利要求1所述的NMOS器件的形成方法,其特征在于,所述基底包括衬底以及位于衬底上的分立的鳍部。
7.如权利要求1所述的NMOS器件的形成方法,其特征在于,所述栅介质层包括界面层以及位于界面层表面的高k栅介质层。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造