[实用新型]一种电子式互感器合并单元的时间同步装置有效
| 申请号： | 201520926054.0 | 申请日： | 2015-11-19 |
| 公开（公告）号： | CN205263514U | 公开（公告）日： | 2016-05-25 |
| 发明（设计）人： | 田晓霄;李水清;方临川;李晓丹 | 申请（专利权）人： | 正泰电气股份有限公司 |
| 主分类号： | G04G7/00 | 分类号： | G04G7/00 |
| 代理公司： | 上海申汇专利代理有限公司 31001 | 代理人： | 翁若莹 |
| 地址： | 201614 *** | 国省代码： | 上海;31 |
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| 摘要： | |||
| 搜索关键词： | 一种 电子 互感器 合并 单元 时间 同步 装置 | ||
1.一种电子式互感器合并单元的时间同步装置，其特征在于，包括CPU、 以太网收发器和现场可编程门阵列芯片，所述的CPU包含以太网MAC控制器 模块和PTP协议模块，所述的以太网收发器连接CPU的以太网MAC控制器模 块，所述现场可编程门阵列芯片通过CPU总线与CPU连接。
2.如权利要求1所述的电子式互感器合并单元的时间同步装置，其特征在 于，所述的所述CPU型号为PowerPC处理器MPC8313或MPC8313E。
3.如权利要求1所述的电子式互感器合并单元的时间同步装置，其特征在 于，所述的以太网收发器为BCM5241。
4.如权利要求1所述的电子式互感器合并单元的时间同步装置，其特征在 于，所述的现场可编程门阵列芯片为EP2C8T144C8。
5.如权利要求1所述的电子式互感器合并单元的时间同步装置，其特征在 于，所述的CPU选用HY5PS561621BFP-25为SDRAM作为程序的运行区域， 选用S29GL064N90TFI03作为其NORFlash，用于存储程序代码，并选用 K9F5608UOD作为其NANDFlash，用于数据的存储。
6.如权利要求1所述的电子式互感器合并单元的时间同步装置，其特征在 于，所述的以太网收发器通过MII接口连接CPU的以太网MAC控制器模块。
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