[发明专利]一种半导体器件及其制造方法在审
| 申请号: | 201510976481.4 | 申请日: | 2015-12-23 |
| 公开(公告)号: | CN106910684A | 公开(公告)日: | 2017-06-30 |
| 发明(设计)人: | 邓浩 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司 |
| 主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L21/28 |
| 代理公司: | 北京市磐华律师事务所11336 | 代理人: | 董巍,高伟 |
| 地址: | 201203 *** | 国省代码: | 上海;31 |
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| 摘要: | |||
| 搜索关键词: | 一种 半导体器件 及其 制造 方法 | ||
1.一种半导体器件的制造方法,其特征在于,包括:
步骤S1:提供半导体衬底,在所述半导体衬底上形成伪栅极结构;
步骤S2:对所述伪栅极结构的一侧壁和与所述侧壁位于同侧的半导体衬底的表面进行倾斜离子注入,以形成离子注入层;
步骤S3:去除所述离子注入层,以使所述伪栅极结构两侧的半导体衬底的表面具有不同的高度;
步骤S4:在所述伪栅极结构两侧的半导体衬底中分别形成源极和漏极,其中,所述源极和所述漏极具有不同的高度。
2.根据权利要求1所述的制造方法,其特征在于,在所述步骤S2之前,还包括:在所述伪栅极结构的表面上形成图案化的掩膜层的步骤。
3.根据权利要求2所述的制造方法,其特征在于,所述步骤S3包括:
步骤S31:在所述半导体衬底上依次形成伪栅极介电层和多晶硅伪栅极材料层;
步骤S32:在所述多晶硅伪栅极材料层上形成所述图案化的掩膜层;
步骤S33:以所述图案化的掩膜层为掩膜依次刻蚀所述多晶硅伪栅极材料层和伪栅极介电层,以形成所述伪栅极结构。
4.根据权利要求1所述的制造方法,其特征在于,在所述步骤S2和所述步骤S3之间还包括进行热退火处理的步骤。
5.根据权利要求1所述的制造方法,其特征在于,所述步骤S4包括以下步骤:
步骤S41:进行LDD注入,以在所述伪栅极结构两侧的半导体衬底中形成轻掺杂源极和漏极;
步骤S42:进行源/漏极注入,以在所述伪栅极结构两侧的半导体衬底中形成源极和漏极。
6.根据权利要求5所述的制造方法,其特征在于,在所述步骤S4之后,还包括在所述源极和漏极对应的区域形成应力层的步骤。
7.根据权利要求6所述的制造方法,其特征在于,所述应力层的材料为SiGe或者SiC。
8.根据权利要求1所述的制造方法,其特征在于,在所述步骤S3和步骤S4之间,还包括在所述伪栅极结构的两侧壁上形成侧墙的步骤。
9.根据权利要求1所述的制造方法,其特征在于,所述离子包括锗,所述离子注入层为锗化硅层。
10.一种采用如权利要求1-9中任一项所述的方法制造的半导体器件。
该专利技术资料仅供研究查看技术是否侵权等信息,商用须获得专利权人授权。该专利全部权利属于中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司,未经中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司许可,擅自商用是侵权行为。如果您想购买此专利、获得商业授权和技术合作,请联系【客服】
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造





