[发明专利]沟槽型MOSFET的ESD结构及工艺方法在审
申请号: | 201510648882.7 | 申请日: | 2015-10-09 |
公开(公告)号: | CN105355626A | 公开(公告)日: | 2016-02-24 |
发明(设计)人: | 陈正嵘 | 申请(专利权)人: | 上海华虹宏力半导体制造有限公司 |
主分类号: | H01L27/02 | 分类号: | H01L27/02;H01L21/82 |
代理公司: | 上海浦一知识产权代理有限公司 31211 | 代理人: | 丁纪铁 |
地址: | 201203 上海市浦东*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 沟槽 mosfet esd 结构 工艺 方法 | ||
1.一种沟槽型MOSFET的ESD结构,在沟槽型MOSFET的周围具有沟槽型保护环,其特征在于:所述的ESD结构集成在沟槽型保护环的沟槽中,所述保护环的沟槽穿过体区底部位于外延层中,沟槽内填充多晶硅;
所述多晶硅分段进行N-P或者P-N,或者N-P-……-N-P或者P-N-……-P-N的间隔掺杂,以形成一个或多个等效串接的二极管,串接的二极管首尾两端电极分别连接沟槽型MOSFET的栅极及源极。
2.如权利要求1所述的沟槽型MOSFET的ESD结构,其特征在于:根据沟槽型MOSFET的ESD耐压需求,换算成等效的PN结的个数,以决定对保护环的沟槽内的多晶硅进行N、P间隔注入的分段数,即形成的等效的二极管的个数。
3.形成如权利要求1所述的沟槽型MOSFET的ESD结构的工艺方法,其特征在于:包含如下的步骤:
第1步,使用硬掩膜在外延上定义出保护环图形,刻蚀形成沟槽型保护环的沟槽;
第2步,移除硬掩膜,在整个外延表面形成一层氧化层作为栅氧化层;
第3步,保护环的沟槽内淀积多晶硅并回刻至外延表面;
第4步,整个外延表面生长一层氧化层,然后进行体区注入;
第5步,使用源区注入的掩膜板,或者保护环掩膜板进行保护环的沟槽的多晶硅的杂质注入,并按照版图将部分沟槽注入反型,形成N、P交替排列的串接的PN结;
第6步,层间介质淀积,刻蚀形成接触孔,将沟槽中多晶硅引出;
第7步,形成阻挡层金属,进行钨淀积,制作金属引线,将沟槽内多晶硅引出形成ESD电路,并将该ESD电路的两端分别与MOSFET的栅极及源极连接。
4.如权利要求3所述的沟槽型MOSFET的ESD结构的工艺方法,其特征在于:所述第1步中,刻蚀的保护环的沟槽深度为1~2μm。
5.如权利要求3所述的沟槽型MOSFET的ESD结构的工艺方法,其特征在于:所述第2步中,淀积的氧化层的厚度为
6.如权利要求3所述的沟槽型MOSFET的ESD结构的工艺方法,其特征在于:所述第3步中,对于NMOS,沟槽内淀积的多晶硅为N型;对于PMOS,沟槽内淀积的多晶硅为P型;多晶硅掺杂浓度为1018~1019atoms/cm3。
7.如权利要求3所述的沟槽型MOSFET的ESD结构的工艺方法,其特征在于:所述第4步中,体区注入能量为120~300keV,剂量为1013~1015atoms/cm2。
8.如权利要求3所述的沟槽型MOSFET的ESD结构的工艺方法,其特征在于:所述第7步中,阻挡层金属为钛和/或氮化钛。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的