[发明专利]上面具有IIIA-N族外延层的机械稳固硅衬底在审
申请号: | 201510079453.2 | 申请日: | 2015-02-13 |
公开(公告)号: | CN104867811A | 公开(公告)日: | 2015-08-26 |
发明(设计)人: | 迈克尔·路易斯·海登;托马斯·安东尼·麦克纳;里克·L·怀斯;萨米尔·彭德哈卡 | 申请(专利权)人: | 德州仪器公司 |
主分类号: | H01L21/02 | 分类号: | H01L21/02;H01L29/06;H01L29/20;H01L29/778 |
代理公司: | 北京律盟知识产权代理有限责任公司 11287 | 代理人: | 林斯凯 |
地址: | 美国德*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 上面 具有 iiia 外延 机械 稳固 衬底 | ||
1.一种形成外延物品的方法,其包括:
使用柴可拉斯基过程参数生长具有3.2×1018/cm3的最小硼掺杂度的元素硅的晶体,所述柴可拉斯基过程参数包含小于(<)平均轴向温度梯度[G]的晶体生长速度(牵引速度)[V];
将所述晶体切割为具有对准于<111>方向的表面的至少一个元素硅衬底;其中所述元素硅衬底中的空位/填隙的比率小于(<)1;
在所述元素硅衬底的所述表面上生长至少一个外延缓冲层,及
在所述缓冲层上生长至少一个外延IIIA-N族层。
2.根据权利要求1所述的方法,其中所述元素硅衬底的杨氏模量比本征硅的杨氏模量高≥25%。
3.根据权利要求1所述的方法,其中所述硼掺杂度是在8.4×1018/cm3与1.2×1020/cm3之间。
4.根据权利要求1所述的方法,其中空位/填隙的所述比率小于(<)0.5。
5.根据权利要求1所述的方法,其中所述缓冲层上的所述IIIA-N族层包含至少第一IIIA-N族层及不同于所述第一IIIA-N族层的第二IIIA-N族层,所述第一IIIA-N族层是在所述第二IIIA-N族层上,且其中所述第二IIIA-N族层及所述第一IIIA-N族层两者均包括AlxGayN或InxAlyN,其中0≤x、y≤1且x+y=1。
6.根据权利要求5所述的方法,其中所述第二IIIA-N族层包括GaN且所述第一IIIA-N族层包括AlGaN。
7.根据权利要求1所述的方法,其中所述生长所述IIIA-N族层包括分子束外延MBE、金属有机化学气相沉积MOCVD或卤化物气相外延HVPE。
8.根据权利要求1所述的方法,其中所述缓冲层包括BN、AlN、GaN、AlGaN或InN或其三元或四元混合物。
9.一种外延物品,其包括:
元素硅衬底,其具有3.2×1018/cm3的最小硼掺杂度及对准于<111>方向的表面;其中所述元素硅衬底中的空位/填隙的比率小于(<)1;
所述元素硅衬底的表面上的至少一个外延缓冲层,及
所述缓冲层上的至少一个外延IIIA-N族层。
10.根据权利要求9所述的外延物品,其中所述硼掺杂度是在8.4×1018/cm3与1.2×1020/cm3之间。
11.根据权利要求9所述的外延物品,其中所述元素硅衬底的杨氏模量比本征硅的杨氏模量高≥25%。
12.根据权利要求9所述的外延物品,其中空位/填隙的所述比率小于(<)0.5。
13.根据权利要求9所述的外延物品,其中所述缓冲层上的所述至少一个外延IIIA-N族层包含至少第一IIIA-N族层及不同于所述第一IIIA-N族层的第二IIIA-N族层,所述第一IIIA-N族层是在所述第二IIIA-N族层上,且其中所述第二IIIA-N族层及所述第一IIIA-N族层两者均包括AlxGayN或InxAlyN,其中0≤x、y≤1且x+y=1。
14.根据权利要求13所述的外延物品,其中所述第二IIIA-N族层包括GaN且所述第一IIIA-N族层包括AlGaN。
15.根据权利要求14所述的外延物品,其进一步包括所述第二IIIA-N族层与所述第一IIIA-N族层之间的InAlN层。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造