[发明专利]可控尺寸及表面结构的纳米柱阵列制备方法无效
| 申请号: | 201410564829.4 | 申请日: | 2014-10-22 |
| 公开(公告)号: | CN104310304A | 公开(公告)日: | 2015-01-28 |
| 发明(设计)人: | 张朝;郭坤平;陈长博;李炜玲;张静;徐韬;魏斌 | 申请(专利权)人: | 上海大学 |
| 主分类号: | B81C1/00 | 分类号: | B81C1/00 |
| 代理公司: | 上海上大专利事务所(普通合伙) 31205 | 代理人: | 何文欣 |
| 地址: | 200444*** | 国省代码: | 上海;31 |
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| 摘要: | |||
| 搜索关键词: | 可控 尺寸 表面 结构 纳米 阵列 制备 方法 | ||
1.一种可控尺寸及表面结构的纳米柱阵列制备方法,其特征在于,包括以下步骤:
ⅰ.对纳米粒子溶液的SiO2粒子进行表面改性,使其具有双亲性,然后采用Langmuir-Blodgett膜工艺,使具有双亲性的SiO2粒子在衬底上沉积得到SiO2单层膜;
ⅱ. 采用各向同性的反应离子刻蚀工艺,对在所述步骤ⅰ中制备的衬底上的SiO2单层膜进行刻蚀,调整SiO2粒子的大小和粒子间隙,对SiO2单层膜进行图案修饰,使SiO2单层膜形成衬底的刻蚀掩模板;
ⅲ. 将在所述步骤ⅱ中制备的经过图案修饰的SiO2单层膜作为刻蚀掩模板,采用各向异性的深度反应离子刻蚀工艺来蚀刻衬底,制备锯齿状表面的纳米柱阵列,此时SiO2粒子留在纳米柱的顶部;
ⅳ. 将在所述步骤ⅱ中制备的经过图案修饰的SiO2单层膜作为刻蚀掩模板,采用感应耦合等离子体刻蚀工艺来蚀刻衬底,制备平整表面的纳米柱阵列,此时SiO2粒子留在纳米柱的顶部;
ⅴ.将在所述步骤ⅲ或步骤ⅳ中得到的带有纳米柱阵列的衬底放置于氢氟酸溶液中,除去残留在纳米柱阵列顶部的SiO2粒子,最终得到具有所需尺寸及表面结构的Si纳米柱阵列的衬底。
2.根据权利要求1所述可控尺寸及表面结构的纳米柱阵列制备方法,其特征在于:在所述步骤ⅰ中采用Langmuir-Blodgett膜工艺在衬底上沉积SiO2粒子过程中,对于900nm级的SiO2粒子,采用的表面压控制在10~14mN/m,而对于600nm级的SiO2粒子,采用的表面压控制在2.5~4mN/m。
3.根据权利要求1所述可控尺寸及表面结构的纳米柱阵列制备方法,其特征在于:在所述步骤ⅱ中,采用各向同性的反应离子刻蚀工艺刻蚀衬底上的SiO2单层膜时,蚀刻气体为CHF3和O2的混合气体,刻蚀腔的气压为250mTorr,RF功率为100W。
4.根据权利要求1所述可控尺寸及表面结构的纳米柱阵列制备方法,其特征在于:在所述步骤ⅲ中,采用各向异性的深度反应离子刻蚀工艺来蚀刻衬底时,蚀刻气体为SF6和O2的混合气体,钝化气体C4F8,刻蚀功率为2100W,钝化功率为2200W。
5.根据权利要求1所述可控尺寸及表面结构的纳米柱阵列制备方法,其特征在于:在所述步骤ⅳ中,采用感应耦合等离子体刻蚀工艺来蚀刻衬底,刻蚀气体Cl2为30sccm,刻蚀腔内压强为10 mTorr,刻蚀功率为40W。
6.根据权利要求1~5中任意一项所述可控尺寸及表面结构的纳米柱阵列制备方法,其特征在于:在所述步骤ⅰ中,采用的衬底的材料为硅、锗、Ⅲ-Ⅴ族半导体材料、有机半导体材料或半导体复合材料。
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