[发明专利]一种半导体器件的制作方法

说明书

本发明提供一种半导体器件的制作方法，包括：步骤一、提供半导体衬底，在所述半导体衬底上形成层间介电层和位于所述层间介电层中的铜互连结构；步骤二、采用含铝元素和氮元素的高分子化合物浸润和清洗所述层间介电层和所述铜互连结构的顶面；步骤三、进行氮气或氨气处理，以形成氮化铝层；步骤四、交替重复所述步骤二和步骤三，直到所述氮化铝层的厚度达到预定值；步骤五、在所述氮化铝层上形成电介质覆盖层。根据本发明提供的采用氮化铝层作为铜互连结构的覆盖层的方法，为器件提供更好的附着性和良好的电迁移性能，提高了器件的可靠性和良品率。

技术领域

本发明涉及半导体技术领域，具体而言涉及一种半导体器件的制作方法。

背景技术

随着半导体制造技术越来越精密，集成电路也发生着重大的变革，集成在同一芯片上的元器件数量已从最初的几十、几百个增加到现在的数以百万个。为了达到复杂度和电路密度的要求，半导体集成电路芯片的制作工艺利用批量处理技术，在衬底上形成各种类型的复杂器件，并将其互相连接以具有完整的电子功能，目前大多采用在导线之间以低k层间介电层作为隔离各金属内连线的介电材料，互连结构用于提供在IC芯片上的器件和整个封装之间的布线。在该技术中，在半导体衬底表面首先形成例如场效应晶体管(FET)的器件，然后在BEOL(集成电路制造后段制程)中形成互连结构。在降低互连线的RC延迟、改善电迁移等方面，金属铜与金属铝相比具有低电阻系数，高熔点和优良的电迁移耐力，在较高的电流密度和低功率的条件下也可以使用。目前，由金属铜和低k层间介电层组成的互连结构具有金属互连线层数目少，芯片速度高、功耗低、制造成本低、高抗电迁移性能等优势。

在当前的铜互连工艺中，作为布线材料的铜具有几个严重的缺点：它可以快速进入相邻的层间介电质区域，可导致在两互连线之间形成导通路径，产生短路；同时铜与层间介电层的附着力也很差，很容易产生脱落(peeling)现象。目前，在铜互连结构形成后，需要在其上形成电介质覆盖层，由于铜与电介质覆盖层的附着力很差，仍然会有铜扩散的现象出现，进而使互连线之间的击穿电压降低，引发器件的可靠性问题。为了解决铜与电介质覆盖层的粘附性问题，同时减少铜的电迁移，人们已提出了一种金属覆盖层的概念，即在金属铜上覆盖一层其他的物质，然后再沉积电介质覆盖层，以提高金属铜与电介质覆盖层间的附着力。

然而，不断缩小的半导体器件的尺寸，以及在半导体衬底上由金属铜和低k层间介电层构成的互连结构所产生的电迁移(EM，electro migration)性能和线电阻(lineresistance)两者之间的权衡已成为目前研究的重点。在半导体器件的互连结构中电迁移是重要的金属失效机理。根据现有技术在形成CuSiN金属覆盖层的过程中大量的硅原子进入半导体器件中，硅原子可以使器件具有较长的电迁移寿命，但是，如图1所示，在形成CuSiN金属覆盖层的过程中提供给半导体器件较多的硅原子时，过量的硅原子会扩散到金属铜连线中，将增加线电阻的阻值，影响互连结构的电学性能。

因此，针对上述问题，有必要提出一种新的制作方法。

发明内容

在发明内容部分中引入了一系列简化形式的概念，这将在具体实施方式部分中进一步详细说明。本发明的发明内容部分并不意味着要试图限定出所要求保护的技术方案的关键特征和必要技术特征，更不意味着试图确定所要求保护的技术方案的保护范围。

为了克服目前存在问题，本发明实施例一提出一种半导体器件的制作方法，包括：

步骤一、提供半导体衬底，在所述半导体衬底上形成层间介电层和位于所述层间介电层中的铜互连结构；

步骤二、采用含铝元素和氮元素的高分子化合物浸润和清洗所述层间介电层和所述铜互连结构的顶面；

步骤三、进行氮气或氨气处理，以形成氮化铝层；

步骤四、交替重复所述步骤二和步骤三，直到所述氮化铝层的厚度达到预定值；

步骤五、在所述氮化铝层上形成电介质覆盖层。