[发明专利]移位寄存单元、移位寄存器和显示装置有效

专利信息
申请号: 201310163879.7 申请日: 2013-05-07
公开(公告)号: CN103258495A 公开(公告)日: 2013-08-21
发明(设计)人: 青海刚;祁小敬 申请(专利权)人: 京东方科技集团股份有限公司;成都京东方光电科技有限公司
主分类号: G09G3/20 分类号: G09G3/20;G11C19/28
代理公司: 北京天昊联合知识产权代理有限公司 11112 代理人: 彭瑞欣;陈源
地址: 100015 *** 国省代码: 北京;11
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摘要:
搜索关键词: 移位 寄存 单元 移位寄存器 显示装置
【权利要求书】:

1.一种移位寄存单元,该移位寄存单元包括驱动信号输入端、驱动信号输出端、第一时钟信号输入端、第二时钟信号输入端、驱动晶体管和输出下拉晶体管,其特征在于,所述输出下拉晶体管的栅极与所述第二时钟信号输入端相连,所述驱动信号输入端输入的低电平为第一低电平,所述输出下拉晶体管的源极与第一低电平输出端连接,所述第一时钟信号输入端和所述第二时钟信号输入端输入的低电平均为第二低电平,所述第一低电平与所述第二低电平的差值大于所述输出下拉晶体管的临界电压的绝对值,使得所述下拉晶体管能够在求值阶段关闭。

2.根据权利要求1所述的移位寄存单元,其特征在于,所述驱动晶体管的栅极形成为上拉节点,所述移位寄存单元还包括与所述上拉节点连接的开关单元,所述开关单元能够在预充电阶段将所述上拉节点与所述驱动信号输入端导通,以对与所述驱动晶体管并联的电容充电,并且所述开关单元能够在求值阶段将所述上拉节点与所述驱动信号输入端断开,以防止所述上拉节点漏电。

3.根据权利要求2所述的移位寄存单元,其特征在于,所述开关单元包括第一开关晶体管和第二开关晶体管,所述第一开关晶体管的栅极与所述第二时钟信号输入端相连,所述第一开关晶体管的漏极与所述驱动信号输入端相连,所述第一开关晶体管的源极与所述第二开关晶体管的漏极相连,所述第二开关晶体管的栅极与所述驱动信号输入端相连,所述第二开关晶体管的源极与所述上拉节点相连。

4.根据权利要求2或3所述的移位寄存单元,其特征在于,所述移位寄存单元包括下拉单元和下拉晶体管,所述下拉晶体管的栅极与所述下拉单元相连,所述下拉晶体管的源极与第二低电平输出端相连,所述下拉单元能够在求值阶段将所述下拉晶体管关闭,并且在复位阶段和非工作阶段将所述下拉晶体管开启,使得所述下拉晶体管能够在所述复位阶段和所述非工作阶段将所述上拉节点的电平拉低至所述第二低电平。

5.根据权利要求4所述的移位寄存单元,其特征在于,所述下拉单元包括第一下拉控制晶体管和第二下拉控制晶体管,所述第一下拉控制晶体管的栅极与所述上拉节点相连,所述第一下拉控制晶体管的源极与第三低电平输出端连接,所述第一下拉控制晶体管的漏极与所述下拉晶体管的栅极连接,所述第二下拉控制晶体管的栅极与所述第二时钟信号输入端相连,所述第二下拉控制晶体管的漏极与高电平输出端连接,所述第二下拉控制晶体管的源极与所述下拉晶体管的栅极连接,所述第二低电平与所述第三低电平的差值大于所述下拉晶体管的临界电压。

6.根据权利要求5所述的移位寄存器单元,其特征在于,所述下拉单元还包括第三下拉控制晶体管,该第三下拉控制晶体管的栅极与所述第一时钟信号输入端相连,所述第三下拉控制晶体管的源极与所述第三低电平输出端相连,所述第三下拉控制晶体管的漏极与所述第二下拉控制晶体管的源极相连。

7.根据权利要求6所述的移位寄存器单元,其特征在于,所述驱动晶体管、所述输出下拉晶体管、所述第一开关晶体管、所述第二开关晶体管、所述下拉晶体管、所述第一下拉控制晶体管、所述第二下拉控制晶体管和所述第三下拉控制晶体管中的至少一者为耗尽型晶体管。

8.一种移位寄存器,该移位寄存器包括多级移位寄存单元,其特征在于,所述移位寄存单元为权利要求1至7中任意一项所述的移位寄存单元,下一级所述移位寄存单元的驱动信号输入端与上一级所述移位寄存器的驱动信号输出端相连。

9.一种显示装置,其特征在于,该显示装置包括权利要求8所述的移位寄存器。

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