[发明专利]一种MOS晶体管的制备方法有效
| 申请号: | 201310050836.8 | 申请日: | 2013-02-08 |
| 公开(公告)号: | CN103985635B | 公开(公告)日: | 2017-10-20 |
| 发明(设计)人: | 赵猛 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司 |
| 主分类号: | H01L21/336 | 分类号: | H01L21/336 |
| 代理公司: | 上海光华专利事务所31219 | 代理人: | 李仪萍 |
| 地址: | 201203 *** | 国省代码: | 上海;31 |
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| 摘要: | |||
| 搜索关键词: | 一种 mos 晶体管 制备 方法 | ||
1.一种MOS晶体管的制备方法,其特征在于,所述制备方法至少包括以下步骤:提供一衬底,在所述衬底上制备栅区域,在预制备MOS晶体管的衬底顶部形成包括源区、漏区及沟道的有源区,位于所述栅区域下且位于源区和漏区之间的衬底顶部为沟道,且所述源区和漏区对所述沟道施加应力;其中,制备所述源区和漏区的具体步骤为:
1)采用湿法刻蚀,在所述栅区域两侧的所述衬底内对称形成V型沟槽;
2)在所述V型沟槽内外延生长应力填充层以填充满所述V型沟槽,在所述栅区域附近的应力填充层中形成轻掺杂区域;
3)以所述栅区域为掩膜,对位于栅区域两侧且形成有所述应力填充层的衬底进行离子注入形成源区及漏区;
其中,在步骤1)中,形成的所述V型沟槽使栅区域部分悬空于所述衬底之上,其中,位于一V型沟槽上的栅区域悬空部分的宽度与栅区域的总宽度之比小于等于1/3;所述V型沟槽的最深处位于所述源区及漏区的底部之上;在所述V型沟槽的最深处位于所述源区及漏区的底部之上时,位于所述V型沟槽开口处的所述源区及漏区凸出处和所述沟道均位于所述衬底顶部,以使所述源区及漏区凸出处离所述沟道更近,从而增强预制备所述源区及漏区对所述沟道施加的应力。
2.根据权利要求1所述的MOS晶体管的制备方法,其特征在于:所述步骤1)中的衬底为(110)晶面衬底,所述V型沟槽侧壁间夹角为113.2°。
3.根据权利要求1所述的MOS晶体管的制备方法,其特征在于:位于一V型沟槽上的栅区域悬空部分的宽度与栅区域的总宽度之比范围是1/5至1/3。
4.根据权利要求1所述的MOS晶体管的制备方法,其特征在于:所述V型沟槽的最深处至所述衬底上表面距离为10~50nm。
5.根据权利要求1所述的MOS晶体管的制备方法,其特征在于:所述步骤2)中外延生长所述应力填充层时通入的掺杂源为含Ge或C元素的第一掺杂源。
6.根据权利要求5所述的MOS晶体管的制备方法,其特征在于:所述步骤2)中外延生长所述应力填充层时通入的掺杂源还包括含B元素的第二掺杂源。
7.根据权利要求5或6所述的MOS晶体管的制备方法,其特征在于:所述步骤2)中所述应力填充层在外延生长时由外层至内层的掺杂浓度逐层增加,而后进行退火,在所述栅区域附近的应力填充层中形成轻掺杂区域。
8.根据权利要求1所述的MOS晶体管的制备方法,其特征在于:所述步骤2)中形成轻掺杂区域采用对位于栅区域两侧且形成有所述应力填充层的衬底进行离子注入并退火的方法。
9.根据权利要求1所述的MOS晶体管的制备方法,其特征在于:所述步骤2)中外延生长应力填充层以填充满所述V型沟槽后继续外延生长。
10.根据权利要求1所述的MOS晶体管的制备方法,其特征在于:所述栅区域包括栅介质层、位于所述栅介质层上的栅极及位于所述栅介质层及栅极两侧的侧墙结构。
11.根据权利要求1所述的MOS晶体管的制备方法,其特征在于:所述衬底的材料为Si、Si1-xCx,Si1-x-yGeyCx,其中,x的范围为0.01~0.1,y的范围为0.1~0.3。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造





