[发明专利]SNR改善电路、同步信息检测电路、通信装置、SNR改善方法以及同步信息检测方法有效
| 申请号: | 201280008399.7 | 申请日: | 2012-01-20 |
| 公开(公告)号: | CN103354981A | 公开(公告)日: | 2013-10-16 |
| 发明(设计)人: | 陈寒达 | 申请(专利权)人: | 株式会社巨晶片 |
| 主分类号: | H04J11/00 | 分类号: | H04J11/00;H04L7/00 |
| 代理公司: | 中国专利代理(香港)有限公司 72001 | 代理人: | 何欣亭;汤春龙 |
| 地址: | 日本大阪*** | 国省代码: | 日本;JP |
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| 摘要: | |||
| 搜索关键词: | snr 改善 电路 同步 信息 检测 通信 装置 方法 以及 | ||
1. 一种改善输入信号的SNR的SNR改善电路(4、4B~4D),具备:
延迟部(50、50D),使所述输入信号延迟并产生一个以上的延迟信号;以及
加法部(60),将所述一个以上的延迟信号与延迟前的所述输入信号相加,
所述输入信号包含相同信号(16)以既定周期(z)重复既定次数的周期信号(14),
所述延迟部以所述既定周期的α倍的延迟时间生成所述一个以上的延迟信号,其中α为自然数,相对于两个以上的延迟信号设定为不同的值。
2. 根据权利要求1所述的SNR改善电路(4B~4D),还具备:
振幅调整部(70),对延迟前的所述输入信号和所述一个以上的延迟信号中的至少一个信号使振幅为β倍,其中β为正数,相对于多个信号分别设定值,
关于所述至少一个信号,所述加法部使用在所述振幅调整部中振幅变为所述β倍以后的信号进行相加,
所述β设定为与不具备所述振幅调整部的构成相比能够减轻在所述加法部中的相加结果的衰减的值。
3. 根据权利要求1所述的SNR改善电路(4、4B~4D),其中,
所述一个以上的延迟信号为所述α=1的延迟信号和所述α=2的延迟信号。
4. 根据权利要求2所述的SNR改善电路(4B~4D),其中,
所述一个以上的延迟信号为所述α=1的延迟信号和所述α=2的延迟信号。
5. 根据权利要求4所述的SNR改善电路(4C),其中,
在所述振幅调整部中处理的所述至少一个信号为所述α=1的所述延迟信号,
相对于所述α=1的所述延迟信号,设定为所述β=4。
6. 一种同步信息检测电路(2),具备:
权利要求1至权利要求5中的任一项所述的SNR改善电路(4、4B~4D);以及
同步信息检测处理电路(3),根据所述SNR改善电路的所述加法部的相加结果,进行检测对所述输入信号的同步信息的处理。
7. 一种通信装置(1),使用分组(10)进行通信,该分组在同步报头(11)中具有相同信号(16)以既定周期(z)重复既定次数的周期信号(14),所述通信装置,具备:
权利要求6所述的同步信息检测电路(2),
所述同步信息检测电路内的所述SNR改善电路,将包含所述分组的接收信号作为所述输入信号而动作,
所述同步信息检测电路内的所述同步信息检测处理电路,通过对来自所述SNR改善电路的输出信号进行所述同步信息的检测处理,与所述同步信息的检测定时同步地输出所述分组的同步定时信号。
8. 一种改善输入信号的SNR的SNR改善方法,具备:
延迟处理(50、50D),使所述输入信号延迟并产生一个以上的延迟信号;以及
加法处理(60),将所述一个以上的延迟信号与延迟前的所述输入信号相加,
所述输入信号包含相同信号(16)以既定周期(z)重复既定次数的周期信号(14),
在所述延迟处理中,以所述既定周期的α倍的延迟时间生成所述一个以上的延迟信号,其中α为自然数,相对于两个以上的延迟信号设定为不同的值。
9. 根据权利要求8所述的SNR改善方法,还具备:
振幅调整处理(70),对延迟前的所述输入信号和所述一个以上的延迟信号中的至少一个信号使振幅为β倍,其中β为正数,相对于多个信号分别设定值,
在所述加法处理中,关于所述至少一个信号,使用在所述振幅调整处理中振幅变为所述β倍以后的信号进行相加,
将所述β设定为与不进行所述振幅调整处理的情况相比能够减轻在所述加法处理中的相加结果的衰减的值。
10. 一种同步信息检测方法,具备:
权利要求8或权利要求9所述的SNR改善方法的各处理;以及
同步信息检测处理(3),根据所述SNR改善方法的所述加法处理的相加结果,进行检测对所述输入信号的同步信息的处理。
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