[实用新型]USB11设备接口的免晶振简易实现电路有效
申请号: | 201220630366.3 | 申请日: | 2012-11-26 |
公开(公告)号: | CN202978897U | 公开(公告)日: | 2013-06-05 |
发明(设计)人: | 不公告发明人 | 申请(专利权)人: | 成都锐成芯微科技有限责任公司 |
主分类号: | H03L7/18 | 分类号: | H03L7/18 |
代理公司: | 暂无信息 | 代理人: | 暂无信息 |
地址: | 610041 四川省成都市*** | 国省代码: | 四川;51 |
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摘要: | |||
搜索关键词: | usb11 设备 接口 免晶振 简易 实现 电路 | ||
1.一种应用于USB11设备接口的免晶振简易实现电路,其特征在于:所述免晶振简易实现电路包括一高频振荡器、一采样时钟分频器、一USB1.1数据接收器、一USB1.1数据状态机、一USB1.1内建时钟判决器、一Delta_Sigma分频器。
2.如权利要求1中所述的内建晶振实现电路,其特征在于:所述高频振荡器的一1A输出端与所述采样时钟分频器的一2A输入端相连;所述采样时钟分频器的一2B输入端与USB1.1模式控制信号SPEED相连,所述采样时钟分频器的一2C输出端与所述USB1.1数据状态机的一4A输入端以及所述USB1.1内建时钟判决器的一5A输入端相连;所述USB1.1数据接收器的一3A输入端与数据总线DP信号相连,所述USB1.1数据接收器的一3B输入端与数据总线DM信号相连,所述USB1.1数据接收器的一3C输出端与所述USB1.1数据状态机的一4D输入端相连,所述USB1.1数据接收器的一3D输出端与所述USB1.1数据状态机的一4C输入端相连,所述USB1.1数据接收器的一3E输出端与所述USB1.1数据状态机的一4B输入端相连;所述USB1.1数据状态机的一4E输入端与所述USB1.1内建时钟判决器的一5B输入端相连;所述USB1.1内建时钟判决器的一5C输出端与所述Delta_Sigma分频器的一6C输入端相连;所述Delta_Sigma分频器的一6B输出端为系统时钟CLK_SYS。
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