[实用新型]一种SPRAM全双工通信控制电路有效
| 申请号： | 201220032779.1 | 申请日： | 2012-02-02 |
| 公开（公告）号： | CN202455364U | 公开（公告）日： | 2012-09-26 |
| 发明（设计）人： | 赵东世;丁西伦 | 申请（专利权）人： | 矽恩微电子（厦门）有限公司 |
| 主分类号： | H04L5/14 | 分类号： | H04L5/14 |
| 代理公司： | 厦门市新华专利商标代理有限公司 35203 | 代理人： | 朱凌 |
| 地址： | 361005 福建省*** | 国省代码： | 福建;35 |
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| 摘要： | |||
| 搜索关键词： | 一种 spram 双工 通信 控制电路 | ||
1.一种SPRAM全双工通信控制电路，其特征在于，包括：
读写冲突记忆电路，连接有读命令输入端和写命令输入端，具有用于记录在读操作过程中写命令的第一锁存器以及与第一锁存器相连并在读命令结束时输出控制指令的第二锁存器；
写命令控制电路，具有第三锁存器，该第三锁存器的复位端与读命令输入端相连，时钟端则与写命令输入端以及第二锁存器的输出端相连并接收控制指令，输出端则连接有写命令输出端；
写操作缓冲存储器，具有数据缓冲存储器和地址缓冲存储器，该数据缓冲存储器的输入端连接有写数据输入端，输出端则连接有写数据输出端；该地址缓冲存储器的输入端连接有写地址输入端；
地址选择电路，两输入端分别连接有读地址输入端和地址缓冲存储器的输出端，输出端则连接有地址输出端，控制端则与读命令输入端相连。
2.如权利要求1所述的一种SPRAM全双工通信控制电路，其特征在于，该写命令控制电路还具有延时复位计数器，该延时复位计数器的时钟端与读写时钟端和写命令输出端或者数据缓冲存储器的使用数量输出端做相与逻辑后的输出端相连，该延时复位计数器的输出端则通过一个与门后，再通过一个延时器后的信号控制第三锁存器的复位端以及延时复位计数器的复位端。
3.如权利要求1所述的一种SPRAM全双工通信控制电路，其特征在于，该地址选择电路的正输入端与读地址输入端相连，负输入端则与地址缓冲器的输出端相连。
4.如权利要求1所述的一种SPRAM全双工通信控制电路，其特征在于，该数据缓冲存储器和地址缓冲存储器均采用多字节存储的先进先出存储器。
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