[发明专利]集成电路的除错系统及其除错方法无效
| 申请号: | 201210559860.X | 申请日: | 2012-12-21 |
| 公开(公告)号: | CN103885845A | 公开(公告)日: | 2014-06-25 |
| 发明(设计)人: | 彭文宏;林敬智;唐惠昱 | 申请(专利权)人: | 祥硕科技股份有限公司 |
| 主分类号: | G06F11/07 | 分类号: | G06F11/07 |
| 代理公司: | 北京纪凯知识产权代理有限公司 11245 | 代理人: | 赵蓉民 |
| 地址: | 中国台湾台北*** | 国省代码: | 中国台湾;71 |
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| 摘要: | |||
| 搜索关键词: | 集成电路 除错 系统 及其 方法 | ||
1.一种集成电路除错系统,用于集成电路,其特征在于,包括:
除错触发多工器,电性连接上述集成电路,上述除错触发多工器侦测上述集成电路的错误事件;
除错信号多工器,电性连接上述集成电路,上述除错信号多工器侦测上述集成电路的上述错误事件,且依据上述错误事件选择并输出上述集成电路的多个待观察信号;
缓存器,电性连接上述除错触发多工器及上述除错信号多工器,接收上述这些待观察信号;
差分信号转换器,耦接上述缓存器;以及
传输接口,电性连接上述差分信号转换器。
2.如权利要求1所述的集成电路除错系统,其特征在于,其中上述缓存器储存上述时间点的上述这待观察信号的值,并将上述这些待观察信号的值嵌入待观察封包来输出。
3.如权利要求2所述的集成电路除错系统,其特征在于,其中当于上述时间点发生上述错误事件,该除错触发多工器输出触发信号至上述缓存器,以触发上述缓存器储存上述时间点的上述这些待观察信号的值。
4.如权利要求2所述的集成电路除错系统,其特征在于,其中上述差分信号转换器将上述待观察封包进行编码并输出多个输出信号至上述传输接口,上述传输接口输出上述这些输出信号。
5.如权利要求3所述的集成电路除错系统,其特征在于,还包括:
仲裁器,电性连接上述集成电路、上述缓存器及上述差分信号转换器,上述仲裁器依据优先权值表依序地输出上述待观察封包及上述集成电路的多个数据封包至上述差分信号转换器。
6.如权利要求4所述的集成电路除错系统,其特征在于,其中上述这些输出信号为差分电压信号。
7.如权利要求4所述的集成电路除错系统,其特征在于,其中上述这些输出信号通过与上述传输接口耦接的显示设备译码并显示。
8.如权利要求7所述的集成电路除错系统,其特征在于,其中上述显示设备为上述传输接口的信号分析仪。
9.一种集成电路除错方法,其特征在于,其与集成电路及除错系统搭配应用,上述除错方法包括下列步骤:
选择上述集成电路的错误事件;
选择上述集成电路的多个待观察信号;
当在某一时间点发生上述错误事件,储存上述时间点的上述这些待观察信号的值,并将上述这些待观察信号的值嵌入待观察封包,来输出上述待观察封包;
依据优先权值表依序地输出上述待观察封包及上述集成电路的多个数据封包;
将上述待观察封包进行编码,来输出多个输出信号;以及
通过上述除错系统的传输接口输出上述这些输出信号。
10.如权利要求9所述的集成电路除错方法,其特征在于,其中上述这些输出信号为差分电压信号。
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