[发明专利]一种移位寄存器单元、栅极驱动电路及显示器件有效
申请号: | 201210546183.8 | 申请日: | 2012-12-14 |
公开(公告)号: | CN103035218A | 公开(公告)日: | 2013-04-10 |
发明(设计)人: | 杨飞 | 申请(专利权)人: | 京东方科技集团股份有限公司 |
主分类号: | G09G3/36 | 分类号: | G09G3/36;G11C19/28 |
代理公司: | 北京中博世达专利商标代理有限公司 11274 | 代理人: | 申健 |
地址: | 100015 *** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 一种 移位寄存器 单元 栅极 驱动 电路 显示 器件 | ||
技术领域
本发明涉及显示技术领域,尤其涉及一种移位寄存器单元、栅极驱动电路及显示器件。
背景技术
随着显示技术的不断发展,人们不仅对显示产品的外观和质量有着苛刻的需求,而且对显示产品的价格和实用性也有着更高的关注。为满足用户的需求,在玻璃基板上集成扫描驱动电路或双边驱动电路等技术也就应运而生,这样一种技术不仅可以使显示产品的生产良率大大提高,同时显著降低了显示产品的价格,从而满足了用户对产品质量和价格的要求。其中一项非常重要的技术就是GOA(Gate Driveron Array,阵列基板行驱动)技术的量产化的实现。利用GOA技术将TFT(Thin Film Transistor,薄膜场效应晶体管)栅极开关电路集成在显示面板的阵列基板上以形成对显示面板的扫描驱动,从而可以省掉栅极驱动集成电路部分,其不仅可以从材料成本和制作工艺两方面降低产品成本,而且显示面板可以做到两边对称和窄边框的美观设计。同时由于可以省去Gate方向Bonding(绑定)的工艺,对产能和良率提升也较有利。这种利用GOA技术集成在阵列基板上的栅极开关电路也称为GOA电路或移位寄存器电路。现有的移位寄存器单元结构集成了大量的信号线和薄膜场效应晶体管,这样不仅漏电严重,导致产品的良率下降,过多的电子器件还将大大增加所占空间,这不但影响美观还会提高产品的生产成本。
发明内容
本发明的实施例提供一种移位寄存器单元、栅极驱动电路及显示器件,可以降低移位寄存单元中集成的信号线和薄膜场效应晶体管的数量。
为达到上述目的,本发明的实施例采用如下技术方案:
本发明实施例的一方面,提供一种移位寄存器单元,包括:上拉模块、下拉模块、控制模块和复位模块;
所述上拉模块,连接所述控制模块、时钟信号和本级信号输出端,用于在所述控制模块和所述时钟信号的控制下将所述本级信号输出端输出的信号上拉为高电平;
下拉模块,连接所述控制模块、第一信号输入端、电压端和所述本级信号输出端,用于在所述控制模块或所述第一信号输入端的控制下将所述本级信号输出端输出的信号下拉为低电平;
控制模块,还连接所述时钟信号和第二信号输入端,用于根据所述时钟信号和所述第二信号输入端输入的信号对所述上拉模块和所述下拉模块进行控制;
复位模块,连接复位信号和所述电压端,用于根据所述复位信号对本级移位寄存器单元进行复位。
本发明实施例的另一方面,提供一种栅极驱动电路,包括多级如上所述的移位寄存器单元;
除第一级移位寄存器单元外,其余每个移位寄存器单元的本级信号输出端连接与其相邻的上一级移位寄存器单元的第一信号输入端;
除最后一级移位寄存器单元外,其余每个移位寄存器单元的本级信号输出端连接与其相邻的下一级移位寄存器单元的第二信号输入端。
本发明实施例的另一方面,提供一种栅极驱动电路,包括多级如上所述的移位寄存器单元;
除第一级移位寄存器单元外,其余每个移位寄存器单元的本级信号输出端连接与其隔行相邻的上一级移位寄存器单元的第一信号输入端;
除最后一级移位寄存器单元外,其余每个移位寄存器单元的本级信号输出端连接与其隔行相邻的下一级移位寄存器单元的第二信号输入端。
本发明实施例的又一方面,提供一种显示器件,包括:
显示区域,具有用于显示图像的多个像素;
栅极驱动电路,用于将扫描信号送至所述显示区域;
数据驱动电路,用于将数据信号送至所述显示区域;
所述栅极驱动电路为如上所述的栅极驱动电路。
本发明实施例提供的移位寄存器单元、栅极驱动电路及显示器件,可以降低移位寄存单元中集成的信号线和薄膜场效应晶体管的数量,从而避免了由于漏电所导致的充电不足的情况,提高了产品的良率,降低了产品的生产成本。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案,下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本发明的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。
图1为本发明实施例提供的一种移位寄存器单元的结构示意图;
图2为本发明实施例提供的一种移位寄存器单元的电路结构示意图;
图3为图2所示的移位寄存器单元工作时的信号时序波形图;
图4为本发明实施例提供的另一移位寄存器单元的电路结构示意图;
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