[发明专利]半导体器件及半导体器件的制造方法有效
申请号: | 201210406251.0 | 申请日: | 2012-10-22 |
公开(公告)号: | CN103779219A | 公开(公告)日: | 2014-05-07 |
发明(设计)人: | 韩秋华 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司 |
主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L29/06;H01L29/78 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 骆苏华 |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 半导体器件 制造 方法 | ||
1.一种半导体器件的制造方法,其特征在于,包括下列步骤:
提供绝缘体上半导体,所述绝缘体上半导体包括衬底、半导体层以及位于所述衬底与所述半导体层之间的绝缘层;
图案化所述半导体层以在所述半导体层上形成凹槽,两个相邻所述凹槽之间为凸起,所述凸起被所述凹槽限定出凸起侧壁;
形成应力改变层覆盖所述凹槽和所述凸起,所述应力改变层对所述凸起产生应力改变作用;
图案化所述应力改变层以在所述应力改变层上形成沟槽,所述沟槽暴露出至少部分所述凸起,所述应力改变层被所述沟槽限定出应力改变层侧壁;
形成侧墙于所述应力改变层侧壁,所述侧墙遮挡部分所述凸起;
形成栅介电层以覆盖所述凸起暴露出的部分;
形成栅电极层以覆盖所述栅介电层,所述栅电极层填充所述沟槽。
2.如权利要求1所述的半导体器件的制造方法,其特征在于,所述栅电极层填充所述沟槽之后,移除位于所述应力改变层上的所述栅电极层。
3.如权利要求1所述的半导体器件的制造方法,其特征在于,所述凹槽下面的半导体层和覆盖所述凹槽的应力改变层形成源极的至少一部分或漏极的至少一部分。
4.如权利要求1所述的半导体器件的制造方法,其特征在于,所述凸起形成沟道的至少一部分。
5.如权利要求1所述的半导体器件的制造方法,其特征在于,所述应力改变层包括硅锗层。
6.如权利要求5所述的半导体器件的制造方法,其特征在于,所述硅锗层包括p型掺杂物。
7.如权利要求1所述的半导体器件的制造方法,其特征在于,所述应力改变层包括硅碳层。
8.如权利要求7所述的半导体器件的制造方法,其特征在于,所述硅碳层包括n型掺杂物。
9.如权利要求1所述的半导体器件的制造方法,其特征在于,采用干法刻蚀图案化所述半导体层。
10.如权利要求1所述的半导体器件的制造方法,其特征在于,采用干法刻蚀图案化所述应力改变层。
11.如权利要求9或10所述的半导体器件的制造方法,其特征在于,采用CF4或CHF3作为刻蚀气体。
12.如权利要求1所述的半导体器件的制造方法,其特征在于,所述凹槽的深度在2nm至20nm之间。
13.如权利要求1所述的半导体器件的制造方法,其特征在于,所述应力改变层的厚度在20nm至200nm之间。
14.一种半导体器件,其特征在于,包括:
绝缘体上半导体,所述绝缘体上半导体包括衬底、半导体层以及位于所述衬底与所述半导体层之间的绝缘层;所述半导体层包括有凹槽,相邻两个所述凹槽之间为凸起;
应力改变层,覆盖所述凹槽,所述应力改变层在所述凸起上方为沟槽;所述沟槽侧面包括有侧墙;
栅介电层,覆盖所述凸起;所述栅介电层被栅电极层覆盖,所述栅电极层填充所述沟槽。
15.如权利要求14所述的半导体器件,其特征在于,所述凹槽定义出源极区域和漏极区域;所述凸起定义出沟道区域。
16.如权利要求15所述的半导体器件,其特征在于,所述应力改变层包括掺杂有p型掺杂物的硅锗层。
17.如权利要求15所述的半导体器件,其特征在于,所述应力改变层包括掺杂有n型掺杂物的硅碳层。
18.如权利要求14所述的半导体器件,其特征在于,所述凹槽的深度在2nm至20nm之间。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造